EPM3128ATI100-10 vs EPM3128ATC100-10 Vergleich

Detaillierter Direktvergleich von EPM3128ATI100-10 von Altera und EPM3128ATC100-10 von Altera. Vergleichen Sie die wichtigsten Spezifikationen, elektrischen Parameter, Gehäuse, Lebenszyklusstatus, Preise und Verfügbarkeit, um das beste Bauteil für Ihre Designanforderungen zu ermitteln.

Spezifikationsvergleich

Parameter EPM3128ATI100-10 EPM3128ATC100-10
Marke Altera Altera
Kategorie FPGA & CPLD FPGA & CPLD
Lebenszyklusstatus Aktiv NRND
Lagerstatus In Stock In Stock
Stückpreis (USD) $8,40 $8,10
Family MAX 3000A —
Device Type CPLD (Complex Programmable Logic Device) CPLD (Complex Programmable Logic Device)
Macro Cells 128 —
Usable Gates 2,500 2500
User I/Os 80 80
Logic Elements / LABs [DATA_NEEDED: LAB count] —
Pin-to-Pin Delay (tPD) 10 ns —
Counter Frequency (fCNT) up to 227.3 MHz —
Supply Voltage (VCCINT) 3.3 V 3.3 V
MultiVolt I/O Levels 5.0 V / 3.3 V / 2.5 V compatible —
Programmability EEPROM, 3.3 V in-system (JTAG) —
Gehäuse TQFP-100 (1.0 mm pitch, 14x14 mm) 100-pin TQFP
Betriebstemperatur -40 °C to +85 °C (industrial) 0 C to 70 C (commercial)
Process Technology CMOS EEPROM —
Open-Drain Output Option Yes (per I/O pin) —
Boundary-Scan (JTAG) IEEE 1149.1 compliant —
RoHS-Status [DATA_NEEDED: RoHS status -10 suffix historically Pb-free; -10N suffix is lead-free] [DATA_NEEDED: RoHS status]
Montageart Surface Mount Surface Mount
Device Family — MAX 3000A
Macrocells — 128
Propagation Delay (tPD) — 10 ns
Counter Frequency — 227.3 MHz
I/O Voltage Tolerance — 5.0 V / 3.3 V / 2.5 V (MultiVolt)
Configuration Memory — EEPROM (non-volatile)
In-System Programming — IEEE Std. 1532 compliant (JTAG)
PCI Compliance — PCI Local Bus Specification Rev 2.2 (selected speed grades)
Logic Family — CMOS

Datenblätter & Ressourcen

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