EP1SGX40DF1020C6 vs EP1SGX40F1020 Comparación

Comparación detallada lado a lado de EP1SGX40DF1020C6 por Altera y EP1SGX40F1020 por Altera. Compare las especificaciones clave, los parámetros eléctricos, el encapsulado, el estado del ciclo de vida, los precios y la disponibilidad para determinar el mejor componente para los requisitos de su diseño.

Altera
EP1SGX40DF1020C6 EP1SGX40DF1020C6 - Stratix GX 41,250 Cells FPGA, 624 I/O | Altera

EP1SGX40DF1020C6 - Stratix GX 41,250 Cells FPGA, 624 I/O | Altera

EP1SGX40DF1020C6 ⚠ Última compra

Comparación de especificaciones

Parámetro EP1SGX40DF1020C6 EP1SGX40F1020
Marca Altera Altera
Categoría FPGA & CPLD FPGA & CPLD
Estado del ciclo de vida Última compra Obsolete
Estado del stock In Stock In Stock
Precio unitario (USD) $1.620,00 $102,10
Series Stratix GX —
Family Stratix GX FPGA Stratix GX
Manufacturer Altera (Intel) —
Logic Cells 41,250 —
Number of LABs/CLBs 4,125 4125
Total RAM Bits [DATA_NEEDED: total RAM bits] 3,423,744
Number of I/O 624 —
Voltage - Supply 1.425 V to 1.575 V (1.5 V nominal) —
Temperatura de funcionamiento 0C to +85C (commercial) —
Encapsulado / Carcasa 1020-BBGA, FCBGA (FC-FBGA) —
Supplier Device Package 1020-FBGA (33 x 33 mm, 1 mm pitch) —
Tipo de montaje Surface Mount Surface Mount
Process Technology 130 nm CMOS —
Maximum Internal Performance 5000 MHz (per datasheet rating) —
Logic Family CMOS, SRAM-based configuration —
Programmable Type In-System Programmable (SRAM) —
High-Speed Transceivers Embedded (per Stratix GX family) —
Configuration Modes JTAG, Passive Serial, Fast Passive Parallel, Active Serial —
Packaging Bulk / Tray —
Estado RoHS [DATA_NEEDED: RoHS compliance] [DATA_NEEDED: confirm from manufacturer page]
Logic Elements — 41,250
Embedded Memory Bits — 3,423,744
User I/O Pins — 624
Number of Transceivers — 20
Transceiver Data Rate — 600 Mbps to 3.1875 Gbps
Encapsulado — 1020-BBGA (FineLine BGA)
Rango de temperatura de funcionamiento — [DATA_NEEDED: industrial/commercial grade]
Tensión de alimentación — [DATA_NEEDED: core and I/O voltage]
Configuration Mode — SRAM-based LUT
JTAG Boundary Scan — Yes

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