EPC2TC32UCAF48XX vs EPC2TC32N Comparación

Comparación detallada lado a lado de EPC2TC32UCAF48XX por Intel y EPC2TC32N por Altera. Compare las especificaciones clave, los parámetros eléctricos, el encapsulado, el estado del ciclo de vida, los precios y la disponibilidad para determinar el mejor componente para los requisitos de su diseño.

Comparación de especificaciones

Parámetro EPC2TC32UCAF48XX EPC2TC32N
Marca Intel Altera
Categoría Memory ICs Memory ICs
Estado del ciclo de vida Obsolete Obsolete
Estado del stock In Stock In Stock
Precio unitario (USD) $10,85 $9,20
Tipo de memoria In-system programmable Configuration PROM (Flash) Flash Configuration PROM
Tamaño de memoria 1.6 Mbit 1.6 Mbit
Configuration Interface Serial (Altera MSEL serial mode) —
Programming Interface JTAG (IEEE 1149.1) 4-wire ISP —
Maximum Serial Clock Frequency 10 MHz —
Encapsulado 48-pin TQFP (CAF, 7x7 mm) 32-TQFP (7x7 mm)
Recuento de pines 48 —
Tipo de montaje Surface Mount Surface Mount
Rango de temperatura de funcionamiento [DATA_NEEDED: operating temperature range] —
Tensión de alimentación [DATA_NEEDED: VCC operating range] —
Erase/Program Cycles 100,000 cycles per sector —
Data Retention 20 years —
Compatible FPGA Families APEX 20K, ACEX 1K, Cyclone, Mercury, Stratix —
Estado RoHS [DATA_NEEDED: RoHS compliance status] [DATA_NEEDED: RoHS compliance status]
Lead-Free / Halogen-Free [DATA_NEEDED: lead-free status] —
Nivel MSL [DATA_NEEDED: MSL level] —
Configuration Mode Support Serial + JTAG ISP (dual mode) —
Manufacturer — Altera (now Intel)
Programmable Type — In System Programmable (ISP)
Interfaz — JTAG (IEEE 1149.1) + serial/parallel
Supply Voltage - VCCINT — 3.0 V to 3.6 V or 4.75 V to 5.25 V
Supply Voltage - VCCIO — 3.0 V to 3.6 V or 4.75 V to 5.25 V
Max Configuration Clock — 8 MHz
Temperatura de funcionamiento — 0 °C to +70 °C (Commercial)
Supported FPGA Families — ACEX 1K, APEX 20K, APEX II, Arria GX, Cyclone, Cyclone II, FLEX 10K, FLEX 6000, Mercury, Stratix, Stratix GX, Stratix II, Stratix II GX
Daisy-Chain Support — Yes (multi-FPGA cascade)
JTAG Compliance — IEEE 1149.1
Configuration Mode — Serial (AS) or Parallel (PS/AP)

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