EPM3256ATC144-7 vs EPM3256AFC256-7 Comparación

Comparación detallada lado a lado de EPM3256ATC144-7 por Altera y EPM3256AFC256-7 por Altera. Compare las especificaciones clave, los parámetros eléctricos, el encapsulado, el estado del ciclo de vida, los precios y la disponibilidad para determinar el mejor componente para los requisitos de su diseño.

Comparación de especificaciones

Parámetro EPM3256ATC144-7 EPM3256AFC256-7
Marca Altera Altera
Categoría FPGA & CPLD FPGA & CPLD
Estado del ciclo de vida Obsolete Obsolete
Estado del stock In Stock In Stock
Precio unitario (USD) $17,06 $12,10
Family MAX 3000A MAX 3000A
Macrocells 256 —
User I/Os 116 161
Logic Elements / Gates 600 to 10,000 usable gates —
Propagation Delay (tPD) 7.5 ns —
Counter Frequency (fCNT) 227.3 MHz —
Speed Grade -7 -7
Supply Voltage - Core (VCCINT) 3.3 V —
Supply Voltage - I/O (VCCIO) 2.5 V / 3.3 V / 5.0 V —
In-System Programming IEEE Std. 1532 compliant, 3.3 V ISP —
Encapsulado TQFP-144 (LFQFP, gull-wing) FBGA-256 (FineLine BGA), 256 balls
Temperatura de funcionamiento 0C to +70C (Commercial) 0 °C to 70 °C (Commercial)
Recuento de pines 144 —
Tipo de montaje Surface Mount —
PCI Compliance PCI Local Bus Specification Revision 2.2 (speed grades -4 to -10) —
JTAG Support IEEE Std. 1149.1 boundary-scan —
Device Type — CPLD (Complex Programmable Logic Device)
Macro Cells — 256
Logic Array Blocks (LABs) — 16
Usable Gates — 10,000
Pin-to-Pin Logic Delay — 4.5 ns (max)
Counter Frequency — 227.3 MHz (max)
Propagation Delay (tpd) — 10 ns
Core Voltage — 3.3 V
I/O Compatibility — 5.0 V / 3.3 V / 2.5 V (MultiVolt I/O)
Process Technology — CMOS EEPROM, 0.30 µm
In-System Programmability — IEEE Std. 1532-compliant 3.3-V ISP
Boundary-Scan Test — JTAG (IEEE 1149.1)
Estado RoHS — [DATA_NEEDED: RoHS compliance status]

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