EPM7128AETC100-7N vs EPM7128SQC100-7N Comparación

Comparación detallada lado a lado de EPM7128AETC100-7N por Altera y EPM7128SQC100-7N por Intel. Compare las especificaciones clave, los parámetros eléctricos, el encapsulado, el estado del ciclo de vida, los precios y la disponibilidad para determinar el mejor componente para los requisitos de su diseño.

Comparación de especificaciones

Parámetro EPM7128AETC100-7N EPM7128SQC100-7N
Marca Altera Intel
Categoría FPGA & CPLD FPGA & CPLD
Estado del ciclo de vida NRND Obsolete
Estado del stock In Stock In Stock
Precio unitario (USD) $31,80 $7,10
Family MAX 7000A MAX 7000S
Device Type CPLD - Complex Programmable Logic Device CPLD - Complex Programmable Logic Device
Macro Cells 128 —
Usable Gates 2,500 2,500
Logic Array Blocks (LABs) 4 —
User I/Os 84 —
Propagation Delay (tpd) 7.5 ns —
Counter Frequency (max) 129.9 MHz —
Internal Frequency (max) 250 MHz —
Core Supply Voltage 3.3 V —
Logic Family CMOS —
Recuento de pines 100 —
Encapsulado 100-TQFP 100-pin PQFP (QFP-100)
Tipo de montaje Surface Mount —
Temperatura de funcionamiento 0 C to +70 C (Commercial) 0C to +70C (commercial)
Programming Interface JTAG (IEEE 1149.1) / ISP —
Estado RoHS [DATA_NEEDED: RoHS status] Compliant (lead-free 'N' suffix)
Process Technology 0.30 µm EEPROM CMOS 0.30 µm CMOS EEPROM
Program Memory Type — EEPROM
Number of Macrocells — 128
Number of Logic Array Blocks — 8
Number of Global Clocks — 2
Product Terms per Macrocell — 32
System Gates — 5,000 (max)
Maximum User I/Os — 84
Pin-to-Pin Delay (tPD) — 7.5 ns
Counter Speed — 175.4 MHz
In-System Programmability — Yes (IEEE 1149.1 JTAG)
Operating Voltage (Core) — 5.0 V
I/O Standard Support — multiVolt (2.5V, 3.3V, 5.0V)
Security Bit — Programmable (one per device)

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