A42MX36-1BGG272 vs A42MX36-3BGG272 Comparaison

Comparaison détaillée côte à côte de A42MX36-1BGG272 par Microchip Technology et A42MX36-3BGG272 par Microchip Technology. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Microchip Technology
A42MX36-1BGG272 A42MX36-1BGG272 - MX FPGA, 54K Gates, 272-BGA | Microchip

A42MX36-1BGG272 - MX FPGA, 54K Gates, 272-BGA | Microchip

A42MX36-1BGG272 ✓ Actif
Microchip Technology
A42MX36-3BGG272 A42MX36-3BGG272 - 54K Gate 5V FPGA, 272-ball BGA | Microchip

A42MX36-3BGG272 - 54K Gate 5V FPGA, 272-ball BGA | Microchip

A42MX36-3BGG272 ✓ Actif

Comparaison des spécifications

Paramètre A42MX36-1BGG272 A42MX36-3BGG272
Marque Microchip Technology Microchip Technology
Catégorie FPGA & CPLD FPGA & CPLD
Statut du cycle de vie Actif Actif
Statut du stock In Stock In Stock
Prix unitaire (USD) $573,16 $328,25
Family MX (42MX) FPGA MX (42MX)
Equivalent Gates 54,000 —
Configurable Logic Blocks (CLBs) 1184 —
Logic Cells 2438 —
Total RAM Bits 2560 —
User I/O 202 —
Fréquence d'horloge maximale 83 MHz —
Speed Grade -1 -3
Tension d'alimentation 5.0 V 5 V
Program Technology Antifuse (one-time programmable) —
Boîtier 272-BBGA 272-ball BGA (BGG272)
Type de montage Surface Mount Surface Mount
Température de fonctionnement [DATA_NEEDED: operating temperature range] [DATA_NEEDED: operating temperature range for this speed grade suffix]
Process Technology CMOS —
Statut RoHS [DATA_NEEDED: RoHS status] [DATA_NEEDED: RoHS status]
Niveau MSL [DATA_NEEDED: moisture sensitivity level] —
Design Software Microchip Libero SoC —
Programmable Type — In-System Programmable FPGA
Logic Blocks (CLBs) — 1184
Equivalent Gate Count — 54000
Programmable I/O — 202
Combinatorial Delay — 1.9 ns
Programming Technology — Antifuse (one-time programmable)
Ceramic/Military Package Option — CQ208 / CQ256 screened to MIL-STD-883 (family option)
Primary Use — 5V ASIC alternative / legacy PLD integration

Fiches techniques et ressources

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