EP20K400GC655-2V vs EP20K400GI655-3V Comparaison

Comparaison détaillée côte à côte de EP20K400GC655-2V par Altera et EP20K400GI655-3V par Intel. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Altera
EP20K400GC655-2V EP20K400GC655-2V - 400K Gate APEX-20KC FPGA 655-CPGA | Altera

EP20K400GC655-2V - 400K Gate APEX-20KC FPGA 655-CPGA | Altera

EP20K400GC655-2V ⚠ Dernier achat

Comparaison des spécifications

Paramètre EP20K400GC655-2V EP20K400GI655-3V
Marque Altera Intel
Catégorie FPGA & CPLD FPGA & CPLD
Statut du cycle de vie Dernier achat Obsolete
Statut du stock In Stock In Stock
Prix unitaire (USD) $92,75 $142,50
Series APEX-20KC APEX 20K
Family APEX 20KC (1.8 V, LVDS) —
Logic Elements 16,640 16,640
Total RAM Bits 212,992 —
System Gates ~400,000 (typical marketing figure) —
Number of I/O [DATA_NEEDED: I/O count] —
Core Voltage (VCCINT) 2.375 V to 2.625 V (nominal 2.5 V) —
Propagation Delay 3.000 ns —
Process Technology CMOS, 0.18 um —
LVDS Support Yes —
Boîtier 655-CPGA (62.48 x 62.48 mm) 655-pin SPGA (Staggered PGA), 47 x 47 mm
Package Type Ceramic Pin Grid Array, through-hole —
Type de montage Through-hole (CPGA) Through-Hole (Pin Grid Array)
Speed Grade -2 —
Température de fonctionnement [DATA_NEEDED: temperature grade] -40 °C to +85 °C (industrial)
Statut RoHS unknown [DATA_NEEDED: RoHS status]
Lead-Free unknown —
Architecture MultiCore (LUT + product-term + embedded memory) —
Device Family — EP20K400
Typical Gate Count — 400,000 gates
Maximum User I/O — 496
Dedicated Inputs — 6
Embedded System Blocks (ESBs) — [DATA_NEEDED: ESB count]
Total Embedded RAM — [DATA_NEEDED: total RAM bits]
Technology — CMOS (0.18 µm process)
Maximum Internal Clock Frequency — 714.2 MHz
Supply Voltage VCCINT — 2.5 V
I/O Supply Voltage VCCIO — 2.5 V or 3.3 V
Niveau de sensibilité à l'humidité (MSL) — 1
Qualification — Not Qualified
Configuration Interface — IEEE 1149.1 JTAG + serial / parallel passive

Fiches techniques et ressources

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