EP20K400GI655-2V vs EP20K400GI655-1V Comparaison

Comparaison détaillée côte à côte de EP20K400GI655-2V par Intel et EP20K400GI655-1V par Intel. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Intel
EP20K400GI655-1V EP20K400GI655-1V - APEX 20K 400K Gate FPGA, 655-pin CBGA | Intel

EP20K400GI655-1V - APEX 20K 400K Gate FPGA, 655-pin CBGA | Intel

EP20K400GI655-1V ⚠ Dernier achat

Comparaison des spécifications

Paramètre EP20K400GI655-2V EP20K400GI655-1V
Marque Intel Intel
Catégorie FPGA & CPLD FPGA & CPLD
Statut du cycle de vie Obsolete Dernier achat
Statut du stock In Stock In Stock
Prix unitaire (USD) $199,50 $155,00
Family APEX 20K APEX 20K
Maximum Gates 400,000 —
Logic Elements 16,640 16,640
Embedded RAM Bits 212,992 —
User I/O Pins 496 —
Dedicated Inputs 6 4
Boîtier SPGA-655 (ceramic, 47 x 47 mm) —
Package Equivalence Code SPGA655,47X47 SPGA655, 47x47
Process Technology 0.18 µm CMOS CMOS
Core Supply Voltage 2.5 V (2.375 V to 2.625 V) 2.5 V
I/O Supply Voltage 3.3 V 2.5 V / 3.3 V
Propagation Delay 3.0 ns to 3.1 ns 2.5 ns
Niveau de sensibilité à l'humidité (MSL) 1 —
Package Body Material Ceramic Ceramic
Température de fonctionnement Industrial (per -2V speed grade) [DATA_NEEDED: industrial vs military grade]
Statut RoHS Non-compliant (ceramic SPGA, contains lead) [DATA_NEEDED]
Typical Gates — 400,000
Maximum User I/O — 502
Package Type — CBGA-655 (Ceramic Ball Grid Array)
Package Code (JESD-30) — S-CPGA-P655
Configuration — In-system programmable via JTAG
Boundary Scan — IEEE 1149.1 JTAG
Niveau MSL — 1

Fiches techniques et ressources

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