EP2S60F1020 vs EP2S60F1020C4N Comparaison

Comparaison détaillée côte à côte de EP2S60F1020 par Altera et EP2S60F1020C4N par Intel. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Altera
EP2S60F1020 EP2S60F1020 - Stratix II FPGA, 60K LEs, 1020-BBGA | Altera

EP2S60F1020 - Stratix II FPGA, 60K LEs, 1020-BBGA | Altera

EP2S60F1020 ⚠ Dernier achat

Comparaison des spécifications

Paramètre EP2S60F1020 EP2S60F1020C4N
Marque Altera Intel
Catégorie FPGA & CPLD FPGA & CPLD
Statut du cycle de vie Dernier achat Obsolete
Statut du stock In Stock In Stock
Prix unitaire (USD) $1 495,00 $67,00
Family Stratix II Stratix II (EP2S60)
Logic Elements (LE) 60,440 —
Adaptive Logic Modules (ALM) 30,220 —
Total Embedded Memory Bits 2,544,192 bits —
Embedded Memory Type TriMatrix (M512 / M4K / M-RAM) —
DSP Blocks 36 (18x18 multipliers) —
Maximum User I/O 718 —
Boîtier 1020-BBGA (flip-chip BGA) 1020-ball FC-FBGA (Fine-pitch Chip-Scale BGA)
Process Technology 90 nm 90 nm CMOS
Supply Voltage (Core) 1.2 V —
Configuration Modes Passive Serial, Fast Passive Parallel, JTAG Passive Serial, Fast Passive Parallel, JTAG
PLLs 12 (4 enhanced + 8 fast) —
Bitstream Encryption 128-bit AES —
Operating Temperature Grades Commercial (C), Industrial (I) —
Statut RoHS Compliant (lead-free variants available) EU RoHS compliant with exemption (per Arrow listing)
Series — Stratix II
Logic Elements — 60,440
Adaptive Logic Modules (ALMs) — 30,220 (approx.)
Logic Array Blocks (LABs) — 3,022
Embedded Memory (bits) — 2,544,192
Embedded Memory Blocks — M512/M4K/M-RAM TriMatrix memory
DSP Blocks (18-bit x 18-bit) — Up to 48 (24 per DSP block column pair typical)
User I/Os — 718
Maximum Core Frequency — 711.24 MHz (per Arrow listing)
Core Voltage — 1.2 V
Type de montage — Surface Mount (BGA)
Operating Temperature Grade — Commercial (C4 suffix indicates commercial, speed grade 4)
PLLs / Clock Networks — Yes - on-chip PLLs and global clock networks

Fiches techniques et ressources

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