EPC1213LC20 vs EPC1064LC20 Comparaison

Comparaison détaillée côte à côte de EPC1213LC20 par Intel et EPC1064LC20 par Intel. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Comparaison des spécifications

Paramètre EPC1213LC20 EPC1064LC20
Marque Intel Intel
Catégorie EEPROM Memory ICs
Statut du cycle de vie Obsolete Obsolete
Statut du stock In Stock In Stock
Prix unitaire (USD) $7,40 $9,85
Type de mémoire OTP Configuration PROM (Flash-based) OTP Configuration PROM (Flash-based, one-time programmable)
Taille de mémoire 212 Kbit 65 kb (65,536 bits)
Interface Serial (Altera FPGA configuration protocol) Serial (Passive Serial / daisy-chain compatible)
Maximum Configuration Clock 6 MHz —
Supply Voltage (Core) 5.0 V —
I/O Voltage Tolerance 3.3 V / 5.0 V —
Programmability One-Time Programmable (OTP) via IEEE 1149.1 JTAG —
In-System Programmability Yes (5.0 V and 3.3 V ISP) —
Supported FPGA Families ACEX 1K, APEX 20K, APEX II, Arria GX, Cyclone, Cyclone II, FLEX 10K, FLEX 6000, Mercury, Stratix, Stratix GX, Stratix II, Stratix II GX —
Compression Support Yes (FPGA decompresses bitstream during load) —
Température de fonctionnement 0C to +70C (Commercial) 0 C to 70 C (Commercial)
Boîtier 20-PLCC (J-lead, 9x9 mm) —
Package Code QCCJ QCCJ (PLCC-20 J-lead)
Type de montage Surface Mount —
Statut RoHS [DATA_NEEDED: RoHS compliance status] Non-compliant (Sn/Pb finish)
Programmable Type — OTP (One-Time Programmable)
Access Time — 90 ns (approximately 10 MHz)
Supply Voltage (Operating) — 4.5 V to 5.5 V
Supply Voltage (Nominal) — 5 V
Boîtier / Format — 20-PLCC (LC) J-lead, 9x9 mm
No. of Terminals — 20
Terminal Finish — Tin/Lead (Sn/Pb)
Package Shape — Square
Compatible Altera FPGA Families — ACEX 1K, APEX 20K, APEX II, FLEX 10K, FLEX 6000, Mercury, Stratix, Stratix GX, Stratix II, Stratix II GX
Configuration Modes Supported — Passive Serial (PS) with FPP up to 100 MHz on newer FPGAs
Niveau MSL — [DATA_NEEDED: MSL level]
Lead-Free — No (Sn/Pb terminal finish)

Fiches techniques et ressources

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