EPC16QI100T vs EPC16QC100N Comparaison

Comparaison détaillée côte à côte de EPC16QI100T par Altera et EPC16QC100N par Altera. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Comparaison des spécifications

Paramètre EPC16QI100T EPC16QC100N
Marque Altera Altera
Catégorie FPGA & CPLD Memory ICs
Statut du cycle de vie Obsolete Obsolete
Statut du stock In Stock In Stock
Prix unitaire (USD) $9,75 $24,10
Product Type Enhanced Configuration PROM (Flash) —
Taille de mémoire 16 Mbit 16 Mbit (16,777,216 bits)
Tension d'alimentation 3.3 V —
Configuration Data Width Serial or 8-bit parallel (FPGA mode dependent) —
Programmable Interface IEEE 1149.1 JTAG (in-system programmable) —
Compression Support Yes (Altera FPGA-side decompression) —
Page-Mode Configuration Yes (multi-device daisy chain) —
Supported FPGAs Stratix, APEX II, APEX 20K, Mercury, ACEX 1K, FLEX 10K —
Température de fonctionnement -40C to +85C (industrial) 0 C to 70 C
Boîtier 100-pin PQFP (Plastic Quad Flat Pack), 20x14 mm 100-pin PQFP (20 x 14 mm)
Type de montage Surface Mount Surface Mount
Shipping Media Tape and Reel (suffix T) —
Configuration Controller Built-in (nCONFIG, nSTATUS, CONF_DONE handshake) —
Statut RoHS [DATA_NEEDED: RoHS compliance] —
Niveau MSL [DATA_NEEDED: MSL rating] —
Programmable Type — In System Programmable
Configuration Clock Frequency — 33 MHz max
On-Chip Decompression — Yes (supports compressed bitstreams)
Supply Voltage (VCC) — 3.0 V to 3.6 V
Access Time — 90 ns typical
Flash Read Bandwidth — 160 Mbps (16-bit DQ at 10 MHz)
Configuration Interface — FPP / PS / AS via dedicated FPGA pins
JTAG (IEEE 1149.1) ISP — Supported
Lead Free — Yes (per datasheet)
Packaging — Tray
Supported FPGA Families — ACEX 1K, APEX 20K, APEX II, Arria GX, Cyclone, Cyclone II, FLEX 10K, FLEX 6000, Mercury, Stratix, Stratix GX, Stratix II, Stratix II GX

Fiches techniques et ressources

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