EPC2LC20CAD vs EPC2L20 Comparaison

Comparaison détaillée côte à côte de EPC2LC20CAD par Altera et EPC2L20 par Altera. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Comparaison des spécifications

Paramètre EPC2LC20CAD EPC2L20
Marque Altera Altera
Catégorie Memory ICs Memory ICs
Statut du cycle de vie Obsolete Obsolete
Statut du stock In Stock In Stock
Prix unitaire (USD) $9,75 $25,80
Type de mémoire Configuration PROM (Flash) Configuration PROM (non-volatile)
Memory Capacity 1.6 Mbit —
Tension d'alimentation 3.3 V (nominal) —
I/O Voltage Tolerance 5 V tolerant —
Configuration Mode Serial (bit-wide, Altera FPGAs) —
Program Interface IEEE Std 1149.1 JTAG (in-system programmable) —
Boîtier 20-pin J-lead PLCC (PLCC-20) 20-pin PLCC (J-lead)
Nombre de broches 20 —
Température de fonctionnement -40C to +85C (commercial) [DATA_NEEDED: operating temperature range]
Maximum Input Voltage (DC) -0.3 V to +7.0 V —
Input Undershoot/Overshoot -2.0 V to +7.0 V for <100 mA, <20 ns no-load —
Compatible FPGA Families APEX 20K, ACEX 1K, Cyclone, Stratix —
Programming Method JTAG ISP (no external programmer required) —
Statut RoHS Compliant RoHS Compliant (per IC Components listing)
Type de montage Surface Mount / Through-hole (PLCC socket) Surface Mount (PLCC socket compatible)
Taille de mémoire — 1.6 Mbit
Organisation de la mémoire — 8-bit byte
Interface — Serial FPGA configuration + JTAG (IEEE 1149.1 / IEEE 1532)
Programmability — In-system programmable via JTAG
Core Supply Voltage (VCCINT) — 3.3 V
I/O Supply Voltage (VCCIO) — 3.3 V or 5.0 V (VCCSEL selectable)
Cascade Support — Yes - multi-device daisy chain
Boundary Scan — JTAG IEEE 1149.1 BST
Niveau MSL — [DATA_NEEDED: MSL rating]
Process Technology — Low-power CMOS
Target FPGAs — APEX II, APEX 20K, Mercury, ACEX 1K, Cyclone, Stratix

Fiches techniques et ressources

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