EPC40C100N vs EPC4QC100N Comparaison

Comparaison détaillée côte à côte de EPC40C100N par Intel et EPC4QC100N par Intel. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Comparaison des spécifications

Paramètre EPC40C100N EPC4QC100N
Marque Intel Intel
Catégorie Memory ICs Memory ICs
Statut du cycle de vie Obsolete NRND
Statut du stock In Stock In Stock
Prix unitaire (USD) $24,75 $8,10
Manufacturer Intel (formerly Altera) —
Part Family Enhanced Configuration Device (EPC) —
Fonction Configuration memory for SRAM-based LUT FPGAs —
Memory Density 40 Mbit (5 Mbyte) —
Memory Technology Non-volatile Flash with internal SRAM buffer —
Programmability In-system programmable via IEEE 1149.1 JTAG —
Configuration Interface Serial (4-wire) or 8-bit parallel Serial / Parallel / JTAG (IEEE 1149.1)
Tension de sortie 3.3 V or 2.5 V selectable —
Configuration Clock Frequency Up to 66 MHz —
Internal Oscillator Yes (eliminates external configuration clock) —
Cascade Support Yes - multiple devices can be chained for >40 Mb bitstreams —
Page Mode Operation Yes - reduces configuration time —
Boîtier PQFP-100 (100-pin Plastic Quad Flat Pack) 100-pin PQFP (Plastic Quad Flat Pack)
Type de montage Surface Mount Surface Mount
Température de fonctionnement -40 C to +85 C (industrial) 0 C to 70 C (commercial)
Compliance RoHS compliant (Pb-free option available) —
Compatible FPGA Families Altera Cyclone, Stratix, APEX, ACEX, Mercury —
Type de mémoire — Flash (NOR, configuration PROM)
Taille de mémoire — 4 Mbit (4,194,304 bits)
Programmable Type — In System Programmable (ISP)
Maximum DCLK Frequency — 66.7 MHz
On-Chip Decompression — Yes
Supply Voltage (VCC) — 3.0 V to 3.6 V
Typical Supply Voltage — 3.3 V
Package Dimensions — 20 x 14 mm
Pin Pitch — 0.65 mm
Packaging — Tray
Lead Free / RoHS — Yes (per chipdig datasheet excerpt)
Family — EPC4 Enhanced Configuration Device
JTAG Support — Yes (IEEE 1149.1 boundary-scan)

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