EPC4QC1C00N vs EPC4QC100N Comparaison

Comparaison détaillée côte à côte de EPC4QC1C00N par Altera et EPC4QC100N par Intel. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Comparaison des spécifications

Paramètre EPC4QC1C00N EPC4QC100N
Marque Altera Intel
Catégorie FPGA & CPLD Memory ICs
Statut du cycle de vie Obsolete NRND
Statut du stock In Stock In Stock
Prix unitaire (USD) $9,10 $8,10
Device Family Enhanced Configuration Device (EPC4) —
Memory Density 4 Mbit (4,194,304 bits) —
Supply Voltage (VCC) 3.0 V to 3.6 V (3.3 V typical) 3.0 V to 3.6 V
I/O Voltage Tolerance 3.3 V / 5 V tolerant —
Interface to FPGA Serial DATA, DCLK, nCONFIG, nSTATUS, CONF_DONE —
Configuration Data Width 4-bit multiplexed on single DATA pin —
Boîtier 100-pin PQFP (QFP-100) 100-pin PQFP (Plastic Quad Flat Pack)
Température de fonctionnement -40 C to +85 C (industrial) 0 C to 70 C (commercial)
In-System Programming JTAG (IEEE 1149.1) —
Programming Voltage On-chip generated, no external VPP —
Page Mode Yes, multi-page storage supported —
Target FPGA Families Stratix, Cyclone, APEX, Mercury, ACEX —
Configuration Clock (DCLK) [DATA_NEEDED: DCLK max frequency] —
Niveau MSL 3 (per JEDEC J-STD-020) —
Statut RoHS [DATA_NEEDED: RoHS compliance status] —
Lead-Free [DATA_NEEDED: lead-free status] —
Type de mémoire — Flash (NOR, configuration PROM)
Taille de mémoire — 4 Mbit (4,194,304 bits)
Programmable Type — In System Programmable (ISP)
Configuration Interface — Serial / Parallel / JTAG (IEEE 1149.1)
Maximum DCLK Frequency — 66.7 MHz
On-Chip Decompression — Yes
Typical Supply Voltage — 3.3 V
Package Dimensions — 20 x 14 mm
Pin Pitch — 0.65 mm
Type de montage — Surface Mount
Packaging — Tray
Lead Free / RoHS — Yes (per chipdig datasheet excerpt)
Family — EPC4 Enhanced Configuration Device
JTAG Support — Yes (IEEE 1149.1 boundary-scan)

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