EPM3064ATI44-10N vs EPM3064ALC44-10N Comparaison

Comparaison détaillée côte à côte de EPM3064ATI44-10N par Altera et EPM3064ALC44-10N par Altera. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Comparaison des spécifications

Paramètre EPM3064ATI44-10N EPM3064ALC44-10N
Marque Altera Altera
Catégorie FPGA & CPLD FPGA & CPLD
Statut du cycle de vie Obsolete Obsolete
Statut du stock In Stock In Stock
Prix unitaire (USD) $3,95 $4,25
Family MAX 3000A —
Product Type CPLD (Complex Programmable Logic Device) —
Macrocells 64 64
Usable Gates 1250 1,250
User I/Os 34 —
Dedicated Inputs 4 —
Logic Blocks 4 —
Pin-to-Pin Delay 10 ns (-10 speed grade) —
Maximum Frequency (fMAX) 100 MHz —
Programmable Type In-System Programmable (EEPROM) —
ISP Interface IEEE Std. 1149.1 (JTAG) —
ISP Standard Compliance IEEE Std. 1532 —
Core Supply Voltage (VCCINT) 3.3 V —
I/O Supply Voltage (VCCIO) 3.3 V or 2.5 V (MultiVolt) —
Température de fonctionnement -40C to +85C (Industrial, "N" suffix) [DATA_NEEDED: commercial / industrial grade]
Boîtier 44-pin TQFP 44-pin PLCC (LC44)
Process Technology CMOS EEPROM —
Boundary-Scan Test Built-in (JTAG) —
Type de montage Surface Mount Surface Mount (PLCC socket compatible)
Lead-Free Status Contains Lead (per digchip datasheet excerpt) —
Statut RoHS Non-Compliant (per digchip datasheet excerpt) Compliant
Product Family — MAX 3000A
Device Type — CPLD (Complex Programmable Logic Device)
Logic Array Blocks (LABs) — 4
User I/O Pins — 34
Propagation Delay (tPD) — 10 ns
Maximum Counter Frequency — 227.3 MHz
Supply Voltage (VCCINT) — 3.0 V to 3.6 V
I/O Bank Voltage (VCCIO) — 3.0 V to 3.6 V (MultiVolt)
Configuration Memory — CMOS EEPROM
In-System Programmability — Yes (IEEE 1149.1 JTAG, IEEE 1532 compliant)
Open-Drain Output Option — Yes (per I/O pin)
Output Slew-Rate Control — Programmable

Fiches techniques et ressources

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