EPM3512AQC208-10NS vs EPM3512AQC208-15N Comparaison

Comparaison détaillée côte à côte de EPM3512AQC208-10NS par Altera et EPM3512AQC208-15N par Altera. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Altera
EPM3512AQC208-15N EPM3512AQC208-15N - 512-Macro CPLD MAX 3000A PQFP-208 | Altera

EPM3512AQC208-15N - 512-Macro CPLD MAX 3000A PQFP-208 | Altera

EPM3512AQC208-15N ⚠ Dernier achat

Comparaison des spécifications

Paramètre EPM3512AQC208-10NS EPM3512AQC208-15N
Marque Altera Altera
Catégorie FPGA & CPLD FPGA & CPLD
Statut du cycle de vie Actif Dernier achat
Statut du stock In Stock In Stock
Prix unitaire (USD) $32,40 $20,50
Family MAX 3000A MAX 3000A
Device Type CPLD (Complex Programmable Logic Device) CPLD - Complex Programmable Logic Device
Macro Cells 512 512
Usable Gates 10,000 —
Logic Array Blocks (LABs) 12 16
User I/Os 172 —
Pin-to-Pin Delay (tPD) 10 ns (speed grade -10) 15 ns
Internal Counter Frequency 227.3 MHz max —
Propagation Delay 7.5 ns (datasheet figure) —
Core Supply Voltage (VCCINT) 3.3 V —
I/O Supply Voltage (VCCIO) 2.5 V / 3.3 V / 5.0 V (MultiVolt) 2.5 V / 3.3 V (MultiVolt)
Logic Family CMOS, EEPROM-based —
Configuration Non-volatile EEPROM, in-system programmable (JTAG IEEE 1532) —
Boîtier 208-pin PQFP PQFP-208 (QC208)
Température de fonctionnement 0C to +70C (commercial) 0C to +70C (commercial)
ISP Standard IEEE Std. 1532 —
Statut RoHS [DATA_NEEDED: rohs status] [DATA_NEEDED: RoHS status]
Type de montage Surface Mount Surface Mount
Maximum User I/O Pins — 172
Typical Usable Gates — 12,000
Number of Logic Elements — 512
Operating Supply Voltage (VCCINT) — 3.3 V
Programmable I/O Standards — LVTTL, LVCMOS, PCI (with external resistor)
In-System Programmability — Yes (IEEE Std. 1532 compliant)
Configuration Memory — EEPROM (non-volatile)
JTAG Support — Yes (BST/Boundary-Scan Test)

Fiches techniques et ressources

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