MX574ALEWI+CDR vs AD574AJDZ Comparaison

Comparaison détaillée côte à côte de MX574ALEWI+CDR par Maxim Integrated et AD574AJDZ par Analog Devices. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Maxim Integrated
MX574ALEWI+CDR MX574ALEWI+CDR - 12-Bit SAR ADC, 25us, 28-SOIC | Maxim

MX574ALEWI+CDR - 12-Bit SAR ADC, 25us, 28-SOIC | Maxim

MX574ALEWI+CDR ✓ Actif
Analog Devices
AD574AJDZ AD574AJDZ - 12-Bit SAR ADC, 28-CDIP | Analog Devices

AD574AJDZ - 12-Bit SAR ADC, 28-CDIP | Analog Devices

AD574AJDZ ✓ Actif

Comparaison des spécifications

Paramètre MX574ALEWI+CDR AD574AJDZ
Marque Maxim Integrated Analog Devices
Catégorie ADC/DAC ADC/DAC
Statut du cycle de vie Actif Actif
Statut du stock In Stock In Stock
Prix unitaire (USD) $19,40 $21,00
Résolution 12 bits 12 bit
Architecture Successive Approximation (SAR) SAR (Successive Approximation)
Conversion Time 25 us (max) 35 us max
Number of Channels 1 1
Analog Input Range 0 to +10 V / 0 to +20 V unipolar; +/-5 V / +/-10 V bipolar —
Input Voltage Type Single-Ended —
Reference Type Internal (on-chip) Internal 10 V buried Zener
Internal Clock Yes (on-chip oscillator) Yes
Output Interface Parallel (8/16-bit bus, tri-state) —
Boîtier / Format 28-pin SOIC (Wide, 300-mil SOP) —
Terminal Form GULL WING —
Terminal Count 28 —
Temperature Grade Commercial —
Température de fonctionnement 0C to +70C (commercial grade) -55C to +125C (J grade)
Type de montage Surface Mount Through-Hole
Shipping Form Tape and Reel (CDR suffix) —
Input Range — 0 to +10 V / 0 to +20 V / -5 to +5 V / -10 to +10 V (software configurable)
Input Type — Single-ended
Data Interface — Parallel (8/16-bit microprocessor bus)
Supply Voltage VCC — +12 V to +15 V nominal
Supply Voltage VLOGIC — +5 V
Supply Voltage VEE — -12 V to -15 V nominal
Boîtier — 28-CDIP (Side Brazed Ceramic DIP)
Statut RoHS — [DATA_NEEDED: confirm on datasheet]
Linear Error — [DATA_NEEDED: bit-level linearity figure]

Fiches techniques et ressources

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