EPC8QC100 vs EPC2TC32V 비교

다음의 상세 나란히 비교: EPC8QC100 제조: Altera 및 EPC2TC32V 제조: Altera. 주요 사양, 전기적 파라미터, 패키징, 수명 주기 상태, 가격 및 재고를 비교하여 설계 요구 사항에 가장 적합한 부품을 결정하십시오.

사양 비교

파라미터 EPC8QC100 EPC2TC32V
브랜드 Altera Altera
카테고리 Memory ICs Memory ICs
수명 주기 상태 Obsolete NRND
재고 상태 In Stock In Stock
단가 (USD) $17.50 $9.20
메모리 유형 Configuration PROM (Flash-based) In-System Programmable Configuration PROM
메모리 크기 8 Mbit 1.6 Mbit
Flash Access Time 90 ns (~10 MHz) —
Configuration Bus Width 16-bit (DQ[]) —
Configuration Bandwidth Up to 160 Mbps —
Decompression Support Yes (Altera proprietary) —
Supported Configuration Modes FPP, PS, AS (FPGA-dependent) —
ISP Interface JTAG (IEEE 1149.1) —
공급 전압 3.3 V —
동작 온도 0C to +70C (Commercial) 0 C to +70 C (commercial)
패키지 100-Pin PQFP (20 x 14 mm) 32-pin TQFP (7 mm x 7 mm)
실장 유형 Surface Mount Surface Mount
Compatible FPGA Families Stratix, APEX II, APEX 20K, Mercury, ACEX 1K, FLEX 10K APEX 20K, APEX II, FLEX 10K/10KE, ACEX 1K, Cyclone (original), Stratix (original)
RoHS 상태 [DATA_NEEDED: RoHS compliance] Compliant
Lead Free [DATA_NEEDED: lead-free status] —
메모리 구성 — x8 (configurable serial/parallel output)
Supply Voltage (VCC) — 3.0 V to 3.6 V (3.3 V nominal)
I/O Voltage Tolerance — 5 V tolerant
인터페이스 — Passive Serial (PS), Passive Parallel Async (PPA), Passive Parallel Sync (PPS), JTAG ISP
Programming Method — In-system via JTAG (IEEE 1149.1)
Cascadable — Yes (multiple EPC2s daisy-chain for larger bitstreams)
MSL 레벨 — [DATA_NEEDED: MSL level]
Configuration Hand-shake Pins — nCONFIG, nSTATUS, CONF_DONE, DCLK
Lead-Free — Yes

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