EP910LC-40H vs EP910LC-35H Сравнение

Подробное сравнение бок о бок EP910LC-40H от Altera и EP910LC-35H от Altera. Сравните ключевые характеристики, электрические параметры, упаковку, статус жизненного цикла, цены и наличие, чтобы выбрать лучший компонент для ваших требований.

Сравнение характеристик

Параметр EP910LC-40H EP910LC-35H
Бренд Altera Altera
Категория FPGA & CPLD FPGA & CPLD
Статус жизненного цикла Obsolete Obsolete
Наличие In Stock In Stock
Цена за единицу (USD) $9,95 $25,00
Family Classic EPLD (EP910) Classic EPLD (EP910)
Macro Cells 24 —
Usable Gates 450 —
Logic Elements 24 macro cells / expandable to 48 via expander terms 24 macrocells
Propagation Delay (tPD) 40 ns max —
Supply Voltage (VCC) 4.75 V to 5.25 V (5 V nominal) 5 V (4.75 V to 5.25 V)
Supply Current (ICC) Low-power CMOS, typical ICC < 100 mA —
Technology CMOS, UV-erasable EPROM CMOS, UV-erasable EPROM
Корпус 40-pin Ceramic DIP (CDIP-40), JEDEC standard 40-pin Ceramic DIP (H suffix)
Тип монтажа Through-Hole (THT) Through-hole (Ceramic DIP)
Рабочая температура -40C to +85C (industrial) [DATA_NEEDED: confirm exact temp grade] [DATA_NEEDED: operating temperature range grade]
Speed Grade -40 (40 ns tPD) —
Programming Method UV-erase + EPROM program, ~100 erase cycles Altera hardware programmer
I/O Pins [DATA_NEEDED: I/O count - datasheet indicates 36 user I/O typical] —
Статус RoHS [DATA_NEEDED: not confirmed from datasheet - non-RoHS likely given vintage ceramic DIP] unknown
Equivalent Gates — 450 usable gates
Propagation Delay (tpd) — 35 ns
User I/O Pins — 36
Dedicated Inputs — 10
Erasure Method — UV (quartz window on H package)
Logic Levels — TTL compatible
Ток покоя — [DATA_NEEDED: typical ICC value]
Process Node — [DATA_NEEDED: process geometry]
Lifecycle — Obsolete (long-term supply via Rochester Electronics)

Даташиты & ресурсы

Все товары Создать BOM Запросить цену