EPM5128GC-1 vs EPM5128GC2 Comparación

Comparación detallada lado a lado de EPM5128GC-1 por Altera y EPM5128GC2 por Altera. Compare las especificaciones clave, los parámetros eléctricos, el encapsulado, el estado del ciclo de vida, los precios y la disponibilidad para determinar el mejor componente para los requisitos de su diseño.

Comparación de especificaciones

Parámetro EPM5128GC-1 EPM5128GC2
Marca Altera Altera
Categoría FPGA & CPLD FPGA & CPLD
Estado del ciclo de vida Obsolete Obsolete
Estado del stock In Stock In Stock
Precio unitario (USD) $18,95 $54,00
Family MAX 5000 MAX 5000
Device Type UV-erasable CMOS CPLD EPLD (Erasable Programmable Logic Device)
Macrocells 128 —
Usable Gates 2,500 2.5K
Dedicated Inputs 7 16
Maximum User I/O Pins 52 —
Nominal Supply Voltage 5 V —
Supply Voltage Range 4.75 V to 5.25 V —
Maximum Operating Frequency 62.5 MHz —
Propagation Delay (tPD) 16 ns (typical, -1 speed grade) —
Encapsulado PGA-96+ (Pin Grid Array, ceramic windowed) Ceramic PGA (GC, windowed)
Technology CMOS, UV-erasable EPROM —
Temperatura de funcionamiento -40C to +85C (industrial) [DATA_NEEDED: operating temperature range]
IOL / IOH 100 mA / 25 mA per pin (legacy figure, [DATA_NEEDED: verify exact drive spec]) —
Security Bit Programmable, prevents readback —
Programming Method UV erase + EPROM program (or device programmer) —
Nivel MSL [DATA_NEEDED: MSL level] —
Estado RoHS [DATA_NEEDED: RoHS compliance - ceramic PGA part is legacy] [DATA_NEEDED: RoHS status]
Macro Cells — 128
Logic Array Blocks (LABs) — 8 (16 macro cells each)
Maximum Internal Frequency — 50 MHz
Supply Voltage VCC — 5 V
I/O Pins — 64
Programmable Flip-Flop Modes — D / T / JK / SR (selectable)
Architecture — AND/OR plane + programmable macro cell + PIA
Process Technology — CMOS EPROM
Reprogrammability — UV-erasable (windowed ceramic package)
Configuration Memory — On-chip EPROM (no external boot device)
Recuento de pines — [DATA_NEEDED: total PGA pin count]

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