EPM7096QC100-10 vs EPM7096LC84-15 Comparación

Comparación detallada lado a lado de EPM7096QC100-10 por Altera y EPM7096LC84-15 por Altera. Compare las especificaciones clave, los parámetros eléctricos, el encapsulado, el estado del ciclo de vida, los precios y la disponibilidad para determinar el mejor componente para los requisitos de su diseño.

Comparación de especificaciones

Parámetro EPM7096QC100-10 EPM7096LC84-15
Marca Altera Altera
Categoría FPGA & CPLD FPGA & CPLD
Estado del ciclo de vida Obsolete Obsolete
Estado del stock In Stock In Stock
Precio unitario (USD) $7,10 $9,85
Family MAX 7000 MAX 7000
Macrocells 96 —
Logic Array Blocks 4 —
User I/O Pins 76 68 (36 per LAB, [DATA_NEEDED: exact LAB-level split])
Propagation Delay (tPD) 10 ns —
Maximum Operating Frequency 100 MHz 76.9 MHz
Supply Voltage (VCC) 4.75 V to 5.25 V 4.75 V to 5.25 V
Technology EEPROM-based CMOS —
Programming Interface ByteBlaster / parallel (JTAG ISP on MAX 7000S variants) IEEE Std. 1149.1 JTAG
Boundary Scan IEEE Std. 1149.1 (JTAG) on MAX 7000S —
PCI Compliance Yes (PCI SIG Local Bus Specification Rev. 2.2 at -10 speed grade) —
Temperatura de funcionamiento 0 °C to +70 °C (commercial) 0C to +70C (commercial)
Encapsulado 100-pin PQFP (R-PQFP-G100, 20×14 mm, 0.65 mm pitch) —
Tipo de montaje Surface Mount Surface Mount
Estado RoHS [DATA_NEEDED: RoHS compliance status] [DATA_NEEDED: RoHS compliance status]
Series — MAX 7000 (second-generation MAX architecture)
Macro Cells — 96
Logic Array Blocks (LABs) — 4
Usable Gates — 1,800
Pin-to-Pin Propagation Delay (tPD) — 15 ns
Programmable Type — EE PLD (in-system programmable via JTAG)
Encapsulado / Carcasa — 84-PLCC (J-Lead)
Supplier Device Package — 84-PLCC (29.31 x 29.31 mm)
Data Retention — [DATA_NEEDED: data retention years]
Erase/Program Endurance — [DATA_NEEDED: erase/program cycle count]

Hojas de datos y recursos

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