EPM7192EGM160-20 vs EPM7192SQC160-10 Comparación

Comparación detallada lado a lado de EPM7192EGM160-20 por Altera y EPM7192SQC160-10 por Altera. Compare las especificaciones clave, los parámetros eléctricos, el encapsulado, el estado del ciclo de vida, los precios y la disponibilidad para determinar el mejor componente para los requisitos de su diseño.

Comparación de especificaciones

Parámetro EPM7192EGM160-20 EPM7192SQC160-10
Marca Altera Altera
Categoría FPGA & CPLD FPGA & CPLD
Estado del ciclo de vida Obsolete NRND
Estado del stock In Stock In Stock
Precio unitario (USD) $15,60 $18,25
Family MAX 7000 MAX 7000S
Device Type EE CMOS CPLD (Electrically Erasable) —
Macrocells 192 192
Logic Array Blocks (LABs) 12 4
Usable Gates 600 to 5,000 3750
Maximum User I/O Pins 120 —
Encapsulado PGA-160 (160-pin Pin Grid Array) PQFP-160 (SQC) 28x28 mm
Speed Grade -20 (20 ns pin-to-pin) —
Pin-to-Pin Propagation Delay 20 ns —
Counter Frequency (max) 175.4 MHz —
I/O Standards 3.3 V or 5 V configurable —
Global Clock Inputs 2 (GCLK1, GCLK2) —
In-System Programming Yes (JTAG IEEE 1149.1) —
Program/Erase Endurance 100 cycles (EEPROM) —
Temperatura de funcionamiento -40C to +125C (industrial) —
Technology Node CMOS, second-generation MAX architecture —
Estado RoHS [DATA_NEEDED: RoHS status] [DATA_NEEDED: RoHS status]
User I/Os — 124
Propagation Delay (tPD) — 10 ns
Maximum Operating Frequency — 100 MHz
Supply Voltage (VCCINT) — 5.0 V
Program Memory Type — EEPROM
In-System Programmability — Yes (JTAG IEEE 1149.1)
Pin/Package Type — Surface Mount, Gull-Wing
Operating Temperature (Commercial) — 0C to +70C
Lead Finish — [DATA_NEEDED: lead finish]

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