EPM9560RC208-20 vs EPM9560RC208-18 Comparación

Comparación detallada lado a lado de EPM9560RC208-20 por Intel y EPM9560RC208-18 por Altera. Compare las especificaciones clave, los parámetros eléctricos, el encapsulado, el estado del ciclo de vida, los precios y la disponibilidad para determinar el mejor componente para los requisitos de su diseño.

Altera
EPM9560RC208-18 EPM9560RC208-18 - MAX 9000 CPLD 560 Macro Cells 5V | Altera

EPM9560RC208-18 - MAX 9000 CPLD 560 Macro Cells 5V | Altera

EPM9560RC208-18 ✗ Fin de vida

Comparación de especificaciones

Parámetro EPM9560RC208-20 EPM9560RC208-18
Marca Intel Altera
Categoría FPGA & CPLD FPGA & CPLD
Estado del ciclo de vida Obsolete Fin de vida
Estado del stock In Stock In Stock
Precio unitario (USD) $0,00 $0,00
Device Family MAX 9000 (EPM9560) MAX 9000 (EPM9560)
Macrocells 560 560 macrocells
Usable Gates 12,000 12,000 gates
Logic Array Blocks 35 —
User I/O Pins 153 —
Pin-to-Pin Delay (tPD) 20 ns —
Frecuencia de reloj máxima 100 MHz —
Tensión de alimentación 5.0 V 5 V
Configuration Technology EEPROM (non-volatile) —
In-System Programmability Yes, via IEEE Std. 1149.1 JTAG —
Encapsulado 208-pin RQFP (28x28 mm) 208-pin RQFP (Power Quad Flat Pack)
Tipo de montaje Surface Mount Surface Mount
Temperatura de funcionamiento 0C to +70C (commercial) [DATA_NEEDED: operating temperature range]
I/O Standards 5.0 V TTL/CMOS compatible —
Flip-Flops 772 772 flip-flops
Estado RoHS [DATA_NEEDED: RoHS status] [DATA_NEEDED: RoHS status]
Nivel MSL [DATA_NEEDED: MSL level] —
Logic Type — EEPROM-based Complex Programmable Logic Device (CPLD)
Propagation Delay (tPD) — 18 ns (speed grade -18)
Maximum Operating Frequency — 117.6 MHz (family -15 grade reference)
I/O Voltage Compatibility — 3.3 V or 5 V
User I/O Lines — 149 I/O lines
Package JESD-30 Code — S-PQFP-G208
Configuration Memory — EEPROM (non-volatile, no external config PROM)
Technology — CMOS
Estado del ciclo de vida — EOL / mature (per Altera product discontinuance notice)

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