EP2A15F672C9 vs EP2A25F672C9ES Comparaison

Comparaison détaillée côte à côte de EP2A15F672C9 par Altera et EP2A25F672C9ES par Intel. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Intel
EP2A25F672C9ES EP2A25F672C9ES - APEX II FPGA 900K Gates 236MHz | Intel

EP2A25F672C9ES - APEX II FPGA 900K Gates 236MHz | Intel

EP2A25F672C9ES ⚠ Dernier achat

Comparaison des spécifications

Paramètre EP2A15F672C9 EP2A25F672C9ES
Marque Altera Intel
Catégorie FPGA & CPLD FPGA & CPLD
Statut du cycle de vie Obsolete Dernier achat
Statut du stock In Stock In Stock
Prix unitaire (USD) $175,00 $122,00
Logic Family APEX II (CMOS) CMOS
Usable Gates 600 K —
Logic Elements 16640 24,320
Macrocells 1664 —
Maximum User I/Os 492 —
Boîtier 672-ball FC-FBGA (27 x 27 mm, 1 mm pitch, FineLine) 672-pin FC-FBGA (FineLine BGA), 27 x 27 mm, 1.0 mm pitch
Process Technology 0.15 µm all-layer copper (up to 8 metal layers) 0.15 µm CMOS (up to 8 metal layers, all-layer copper)
Core Supply Voltage 1.5 V 1.5 V
I/O Supply Voltage 3.3 V —
Maximum Internal Frequency 379 MHz —
Propagation Delay 1.94 ns 1.69 ns
High-Speed I/O Support True-LVDS, LVPECL, PCML, HyperTransport up to 1 Gbps —
Embedded Memory ESB dual-port RAM / FIFO —
Température de fonctionnement 0 °C to 85 °C (commercial) 0 °C to 85 °C (Commercial)
Configuration Interface Passive serial / Active serial / JTAG (IEEE 1149.1) —
PLLs On-chip PLLs for clock synthesis and deskew —
Compliance RoHS - [DATA_NEEDED: status not in verified data]; IEEE 1149.1 boundary scan —
Family — APEX II
System Gates — 900,000
Maximum Operating Frequency — 236 MHz
User I/Os — 492
Speed Grade — -9
Configuration Class — ES (Enhanced)
Type de montage — Surface Mount
Statut RoHS — [DATA_NEEDED: RoHS compliance status]
Niveau MSL — [DATA_NEEDED: MSL moisture sensitivity level]

Fiches techniques et ressources

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