EP610JI-30 vs EP610ILC-25 Comparaison

Comparaison détaillée côte à côte de EP610JI-30 par Altera et EP610ILC-25 par Altera. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Comparaison des spécifications

Paramètre EP610JI-30 EP610ILC-25
Marque Altera Altera
Catégorie FPGA & CPLD FPGA & CPLD
Statut du cycle de vie NRND Obsolete
Statut du stock In Stock In Stock
Prix unitaire (USD) $9,40 $9,85
Family Altera Classic EPLD (EP610) Classic EPLD (EP610 series)
Device Type UV Erasable Programmable Logic Device (EPLD) EEPLD (Electrically Erasable PLD)
Macrocells 16 16
Propagation Delay (tpd) 30 ns (max) —
Pipelined Data Rate Up to 100 MHz —
Product Terms 160 160
Dedicated Inputs 4 4
I/O Pins 16 —
External Clocks 2 —
Tension d'alimentation 5 V (single supply) —
Process Technology CMOS CMOS, electrically erasable
Boîtier CQCC28 (windowed ceramic JLCC, J-bend) 28-pin PLCC (J-lead)
Package Code JLCC-28 / CQCC28 —
Erasure Method Ultraviolet (UV) via top window —
Programming Altera Logic Programmer compatible —
Température de fonctionnement -40C to +85C (industrial, per EP610 family suffix convention) —
Type de montage Surface Mount (JLCC) Surface Mount
Statut RoHS [DATA_NEEDED: RoHS status - vintage ceramic package, likely non-RoHS] [DATA_NEEDED: RoHS status]
Lead-Free [DATA_NEEDED: lead-free status] —
Usable Gates — 300
Maximum Operating Frequency (fMAX) — 40 MHz
Pin-to-Pin Propagation Delay (tPD) — 25 ns
Supply Voltage (VCC) — 4.75 V to 5.25 V
Nominal Supply Voltage — 5 V
Total Inputs — 20
Bidirectional I/O Pins — 16
Plage de température de fonctionnement — 0 C to +70 C (commercial)
Programming Method — In-system, electrically erasable

Fiches techniques et ressources

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