EP910DI-35 vs EP910DC-30 Comparaison

Comparaison détaillée côte à côte de EP910DI-35 par Altera et EP910DC-30 par Intel. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Comparaison des spécifications

Paramètre EP910DI-35 EP910DC-30
Marque Altera Intel
Catégorie FPGA & CPLD FPGA & CPLD
Statut du cycle de vie Actif Obsolete
Statut du stock In Stock In Stock
Prix unitaire (USD) $35,20 $15,60
Product Type EPLD (Erasable Programmable Logic Device) —
Family Altera Classic EPLD Classic EPLD (EP910 series)
Macrocells 24 24
Usable Gates 450 —
Propagation Delay (tPD) 35 ns 30 ns (max)
Maximum Toggle Frequency (fCNT) 28.6 MHz —
Supply Voltage (VCC) 4.75 V to 5.25 V (5 V nominal) —
Supply Current (ICC) 40 mA typical —
Dedicated Inputs 10 36
Bidirectional I/O Pins 20 —
Total Pins 40 —
Boîtier CDIP-40 (Ceramic DIP with UV window) DIP-40 (through-hole, 600 mil)
Type de montage Through-Hole Through-Hole
Température de fonctionnement -40C to +85C (industrial) 0C to +70C (commercial)
Technology CMOS, UV-erasable EPROM —
Programming Method EPROM programmer + JEDEC fuse map UV-Erasable / OTP
Erasure Method UV light through quartz window —
Statut RoHS [DATA_NEEDED: RoHS status - ceramic CDIP legacy parts are typically non-compliant unless specified] —
Logic Family PAL-type AND/OR array with D flip-flops —
Manufacturer Original Altera; long-term authorized by Rochester Electronics, LLC —
Architecture — PAL-type AND-OR sum-of-products, CMOS
Gate Count — 900 usable gates
Clock Frequency (fCNT) — 33.3 MHz
Outputs (Macrocells) — 24
External Clock Pins — 2 (CLK1, CLK2)
Tension d'alimentation — 5 V
Process Technology — CMOS

Fiches techniques et ressources

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