EPC1064LC20 vs EPC1441LI20 Comparaison

Comparaison détaillée côte à côte de EPC1064LC20 par Intel et EPC1441LI20 par Intel. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Comparaison des spécifications

Paramètre EPC1064LC20 EPC1441LI20
Marque Intel Intel
Catégorie Memory ICs Memory ICs
Statut du cycle de vie Obsolete Obsolete
Statut du stock In Stock In Stock
Prix unitaire (USD) $9,85 $8,10
Taille de mémoire 65 kb (65,536 bits) —
Type de mémoire OTP Configuration PROM (Flash-based, one-time programmable) OTP Configuration PROM (PROM)
Programmable Type OTP (One-Time Programmable) —
Interface Serial (Passive Serial / daisy-chain compatible) —
Access Time 90 ns (approximately 10 MHz) —
Supply Voltage (Operating) 4.5 V to 5.5 V —
Supply Voltage (Nominal) 5 V —
Température de fonctionnement 0 C to 70 C (Commercial) -40 C to +85 C (industrial)
Boîtier / Format 20-PLCC (LC) J-lead, 9x9 mm —
No. of Terminals 20 —
Terminal Finish Tin/Lead (Sn/Pb) —
Package Code QCCJ (PLCC-20 J-lead) —
Package Shape Square —
Compatible Altera FPGA Families ACEX 1K, APEX 20K, APEX II, FLEX 10K, FLEX 6000, Mercury, Stratix, Stratix GX, Stratix II, Stratix II GX —
Configuration Modes Supported Passive Serial (PS) with FPP up to 100 MHz on newer FPGAs —
Statut RoHS Non-compliant (Sn/Pb finish) [DATA_NEEDED: RoHS compliance status]
Niveau MSL [DATA_NEEDED: MSL level] [DATA_NEEDED: MSL rating]
Lead-Free No (Sn/Pb terminal finish) [DATA_NEEDED: lead-free status]
Density — 441 kbits (440,800 bits)
Number of Words — 440,800
Bits per Word — 1 bit
Configuration Interface — Altera 4-pin serial (DATA, DCLK, nCONFIG, nSTATUS)
Supported FPGA Families — ACEX, APEX 20K / 20KC / 20KE, FLEX 10KE, FLEX 10KA, Mercury
Tension d'alimentation — 3.3 V
Boîtier — 20-pin PLCC (J-lead, 9x9 mm)
Pin Pitch — 1.27 mm
Programming Method — One-Time-Programmable via Altera programming hardware
Configuration Time — Depends on FPGA bitstream length and DCLK frequency

Fiches techniques et ressources

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