EPC16UC80 vs EPC16QC100N Comparaison

Comparaison détaillée côte à côte de EPC16UC80 par Altera et EPC16QC100N par Altera. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Comparaison des spécifications

Paramètre EPC16UC80 EPC16QC100N
Marque Altera Altera
Catégorie Memory ICs Memory ICs
Statut du cycle de vie Dernier achat Obsolete
Statut du stock In Stock In Stock
Prix unitaire (USD) $11,75 $24,10
Memory Density 16 Mbit —
Device Family EPC4 / EPC8 / EPC16 Enhanced Configuration Device —
Configuration Memory Sections 8 (multi-boot capable) —
Supply Voltage (VCC) 3.0 V to 3.6 V (typical 3.3 V) 3.0 V to 3.6 V
Configuration Clock (DCLK) Up to 33 MHz (FPP mode) —
Configuration Modes FPP, PS, JTAG —
Interface Parallel data + DCLK + nSTATUS + nCONFIG + CONFIG_DONE —
In-System Programmability Yes (IEEE 1149.1 JTAG) —
Endurance 100,000 erase/program cycles (per datasheet) —
Température de fonctionnement -40 C to +85 C (industrial) 0 C to 70 C
Boîtier 80-ball UBGA (Ultra FineLine BGA), 11x8 mm 100-pin PQFP (20 x 14 mm)
Type de montage Surface Mount Surface Mount
Supported Target FPGAs Stratix/II/III/GX, Cyclone/II/III, APEX 20K/II/IIE, Mercury —
Lead-Free / RoHS Compliant per Altera product page —
Multi-Device Daisy-Chain Yes —
Taille de mémoire — 16 Mbit (16,777,216 bits)
Programmable Type — In System Programmable
Configuration Clock Frequency — 33 MHz max
On-Chip Decompression — Yes (supports compressed bitstreams)
Access Time — 90 ns typical
Flash Read Bandwidth — 160 Mbps (16-bit DQ at 10 MHz)
Configuration Interface — FPP / PS / AS via dedicated FPGA pins
JTAG (IEEE 1149.1) ISP — Supported
Lead Free — Yes (per datasheet)
Packaging — Tray
Supported FPGA Families — ACEX 1K, APEX 20K, APEX II, Arria GX, Cyclone, Cyclone II, FLEX 10K, FLEX 6000, Mercury, Stratix, Stratix GX, Stratix II, Stratix II GX

Fiches techniques et ressources

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