EPC2LI20 vs EPC2LC20-T Comparaison

Comparaison détaillée côte à côte de EPC2LI20 par Altera et EPC2LC20-T par Altera. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Altera
EPC2LC20-T EPC2LC20-T - 1.6Mb FPGA Config PROM PLCC-20 | Altera

EPC2LC20-T - 1.6Mb FPGA Config PROM PLCC-20 | Altera

EPC2LC20-T ⚠ Dernier achat

Comparaison des spécifications

Paramètre EPC2LI20 EPC2LC20-T
Marque Altera Altera
Catégorie Memory ICs Memory ICs
Statut du cycle de vie NRND Dernier achat
Statut du stock In Stock In Stock
Prix unitaire (USD) $5,95 $7,40
Taille de mémoire 1.6 Mb (1,572,864 bits) 1.6 Mb
Type de mémoire Flash (in-system programmable) Configuration PROM (Flash)
Programmable Type In System Programmable (ISP) —
Fonction Configuration PROM for SRAM-based FPGAs —
Supply Voltage - Operating 3.0 V to 3.6 V and 4.5 V to 5.5 V (auto-sensing) —
Température de fonctionnement -40 C to +85 C (Industrial) -40C to +85C (industrial)
Boîtier / Format 20-PLCC (J-lead, 9x9 mm) —
Type de montage Surface Mount (PLCC socket-compatible) Surface Mount
Configuration Interface Serial or Byte-wide (parallel) —
Decompression On-chip (supports compressed bitstreams) —
JTAG / ISP Interface IEEE 1532 (TCK, TMS, TDI, TDO) —
Multi-Device Support Yes (daisy-chain configuration) —
User-Accessible Memory Yes (unused flash available to user logic) —
Statut RoHS [DATA_NEEDED: RoHS status] Compliant
Niveau MSL [DATA_NEEDED: MSL level] —
Configuration Mode — Serial (PS mode), cascadable
Max Configuration Frequency — 10 MHz
Tension d'alimentation — 3.3 V (typical)
Programmability — In-System Programmable via JTAG
JTAG Interface — IEEE Std 1149.1-1990 compliant
Supported FPGA Families — ACEX, APEX, Cyclone, FLEX, MAX 7000A/B, MAX II, Mercury
Cascade Support — Yes (nCASC pin)
Boîtier — 20-PLCC (9x9 mm)
Packaging Suffix — -T = Tape and Reel
Lead-Free — Yes

Fiches techniques et ressources

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