EPC4Q100T vs EPC4QI100N Comparaison

Comparaison détaillée côte à côte de EPC4Q100T par Intel et EPC4QI100N par Altera. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Comparaison des spécifications

Paramètre EPC4Q100T EPC4QI100N
Marque Intel Altera
Catégorie FPGA & CPLD Memory ICs
Statut du cycle de vie NRND Actif
Statut du stock In Stock In Stock
Prix unitaire (USD) $9,75 $10,40
Taille de mémoire 4 Mbit 4 Mbit (4,194,304 bits)
Type de mémoire Flash (non-volatile) In-System Programmable Configuration PROM (NOR flash)
Fonction Enhanced Configuration Device for SRAM-based LUT FPGAs —
Configuration Modes Supported PS, FPP (16-bit), AS —
Flash Access Time 90 ns (approx 10 MHz core clock) —
Maximum Configuration Data Rate 160 Mbps (FPP, 16-bit bus) —
Largeur du bus de données 16-bit (DQ[15:0]) —
In-System Programming Yes (JTAG IEEE 1149.1) —
Supply Voltage (Core) 3.3 V —
I/O Voltage Tolerance 3.3 V (5 V tolerant on legacy interface pins) —
Package Type PQFP-100 (Plastic Quad Flat Pack) —
Package Dimensions 20 x 14 mm —
Plage de température de fonctionnement [DATA_NEEDED: operating temperature range] —
Compatible FPGA Families Stratix, Cyclone, APEX, Mercury, ACEX —
Statut RoHS [DATA_NEEDED: RoHS status] [DATA_NEEDED: RoHS compliance]
Manufacturer Intel (formerly Altera) —
Programmable Type — In System Programmable (ISP via JTAG)
Supply Voltage (VCC) — 3.0 V to 3.6 V
Interface — Altera serial (x1) configuration + JTAG
Configuration Clock DCLK — [DATA_NEEDED: DCLK maximum frequency]
Active Supply Current (ICC active) — [DATA_NEEDED: ICC active typical value]
Standby Supply Current — [DATA_NEEDED: ICC standby typical value]
Température de fonctionnement — -40C to +85C (industrial)
Storage Temperature — -65C to +150C
Boîtier — 100-pin PQFP (PowerPQFP, 20x14 mm)
Package Code — QI100 (PQFP-100, industrial)
Type de montage — Surface Mount
Niveau MSL — [DATA_NEEDED: MSL rating]
JTAG Standard — IEEE 1149.1 boundary-scan / ISP
Cascading — Supported (multi-device daisy chain)
Target FPGAs — Altera Cyclone, Cyclone II, Stratix series

Fiches techniques et ressources

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