EPC80C100T vs EPC40C100 Comparaison

Comparaison détaillée côte à côte de EPC80C100T par Intel et EPC40C100 par Altera. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Comparaison des spécifications

Paramètre EPC80C100T EPC40C100
Marque Intel Altera
Catégorie FPGA & CPLD FPGA & CPLD
Statut du cycle de vie NRND Obsolete
Statut du stock In Stock In Stock
Prix unitaire (USD) $25,40 $10,50
Product Type Enhanced Configuration Device for SRAM-based LUT FPGAs —
Manufacturer Intel (formerly Altera) —
Family Enhanced Configuration (EPC) Devices —
Memory Density [DATA_NEEDED: density in Mbit] 40 Mbit
Tension d'alimentation 3.0 V to 3.6 V (3.3 V typical) —
Configuration Modes FPP, PPS, PPA, PS, JTAG —
JTAG Interface IEEE 1149.1 in-system programming —
Internal Oscillator 50 MHz —
Multi-Boot Pages Up to 8 configuration pages —
Page-Mode Read Supported —
In-System Programmability Yes (continuous, via JTAG) —
Boîtier 100-pin PQFP (T = tape and reel) 100-pin EQFP (Enhanced Quad Flat Pack)
Compatible FPGA Families APEX 20K, APEX II, Mercury, ACEX 1K, Cyclone, Stratix —
Température de fonctionnement -40C to +85C (industrial, [DATA_NEEDED: confirm grade]) —
Statut RoHS [DATA_NEEDED: verify from manufacturer page] Compliant
Lead-Free [DATA_NEEDED: verify from manufacturer page] Yes
Device Family — Enhanced Configuration Device
Target FPGAs — Stratix, Cyclone, APEX, Mercury, ACEX families
Configuration Mode — FPP (Fast Passive Parallel) / PS (Passive Serial)
Interface Voltage — 2.5 V / 3.3 V
Maximum FPP Clock Frequency — 66 MHz
Programmability — In-system programmable (JTAG)
Error Detection — Built-in CRC verification
Plage de température de fonctionnement — -40 C to +85 C (industrial)
Pin Pitch — 0.5 mm
Type de montage — Surface Mount
Niveau MSL — 3 (168 hours)
Type de mémoire — NOR Flash

Fiches techniques et ressources

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