EPM3064AT100-10N vs EPM3064ATC100-7N Comparaison

Comparaison détaillée côte à côte de EPM3064AT100-10N par Altera et EPM3064ATC100-7N par Altera. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Comparaison des spécifications

Paramètre EPM3064AT100-10N EPM3064ATC100-7N
Marque Altera Altera
Catégorie FPGA & CPLD FPGA & CPLD
Statut du cycle de vie NRND NRND
Statut du stock In Stock In Stock
Prix unitaire (USD) $5,45 $6,10
Family MAX 3000A MAX 3000A
Device Type CPLD (Complex Programmable Logic Device) CPLD - Complex Programmable Logic Device
Macrocells 64 64
Logic Array Blocks (LABs) 4 2
Usable Gates 1,250 up to 1,250
User I/O Pins 66 66
Speed Grade -10 (10 ns pin-to-pin delay) —
Supply Voltage (VCCINT) 3.3 V —
I/O Bank Voltage 3.3 V —
5 V Tolerant Inputs Yes (via clamping diodes) —
Configuration Memory EEPROM (non-volatile) —
Programming Interface JTAG (IEEE Std. 1149.1) with pin-locking —
ISP Compliance IEEE Std. 1532 —
Boundary-Scan Test (BST) IEEE Std. 1149.1 compliant —
Boîtier TQFP-100 (T100), 14 mm x 14 mm TQFP-100
Operating Temperature (Commercial) 0C to +70C —
Statut RoHS [DATA_NEEDED: RoHS compliance status] [DATA_NEEDED: confirmed RoHS status from manufacturer page]
Lead-Free [DATA_NEEDED: lead-free finish] —
Propagation Delay (tPD) — 7.5 ns (pin-to-pin, -7 speed grade)
Maximum Internal Frequency — 166.7 MHz (-7 speed grade)
Core Supply Voltage (VCCINT) — 3.3 V
I/O Supply Voltage (VCCIO) — 3.3 V or 2.5 V
Program Memory Technology — EEPROM (non-volatile)
In-System Programming — IEEE Std. 1149.1 (JTAG), IEEE Std. 1532
Type de montage — Surface Mount
Température de fonctionnement — 0 °C to +70 °C (commercial)

Fiches techniques et ressources

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