EPM3512AQC208-15N vs EPM3512AQC208-7 Comparaison

Comparaison détaillée côte à côte de EPM3512AQC208-15N par Altera et EPM3512AQC208-7 par Intel. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Altera
EPM3512AQC208-15N EPM3512AQC208-15N - 512-Macro CPLD MAX 3000A PQFP-208 | Altera

EPM3512AQC208-15N - 512-Macro CPLD MAX 3000A PQFP-208 | Altera

EPM3512AQC208-15N ⚠ Dernier achat

Comparaison des spécifications

Paramètre EPM3512AQC208-15N EPM3512AQC208-7
Marque Altera Intel
Catégorie FPGA & CPLD FPGA & CPLD
Statut du cycle de vie Dernier achat NRND
Statut du stock In Stock In Stock
Prix unitaire (USD) $20,50 $41,72
Family MAX 3000A MAX 3000A
Device Type CPLD - Complex Programmable Logic Device CPLD (Complex Programmable Logic Device)
Macro Cells 512 —
Logic Array Blocks (LABs) 16 —
Maximum User I/O Pins 172 —
Typical Usable Gates 12,000 —
Number of Logic Elements 512 —
Pin-to-Pin Delay (tPD) 15 ns —
Operating Supply Voltage (VCCINT) 3.3 V —
I/O Supply Voltage (VCCIO) 2.5 V / 3.3 V (MultiVolt) —
Programmable I/O Standards LVTTL, LVCMOS, PCI (with external resistor) —
In-System Programmability Yes (IEEE Std. 1532 compliant) —
Configuration Memory EEPROM (non-volatile) —
JTAG Support Yes (BST/Boundary-Scan Test) —
Boîtier PQFP-208 (QC208) 208-Pin PQFP (FQFP, gull-wing)
Type de montage Surface Mount —
Température de fonctionnement 0C to +70C (commercial) 0 C to +70 C (commercial)
Statut RoHS [DATA_NEEDED: RoHS status] Compliant
Macrocells — 512
Usable Gates — 10,000
Propagation Delay (tPD) — 7.5 ns
Counter Frequency (fCNT) — 116.3 MHz
User I/Os — 172
Logic Elements / LEs — N/A (CPLD macrocell architecture)
Supply Voltage (VCCINT) — 3.3 V
I/O Standards Supported — 5.0 V, 3.3 V, 2.5 V (MultiVolt I/O)
Programming — In-System Programmable via JTAG (IEEE Std. 1532)
Process Technology — CMOS EEPROM, 0.30 um
Lead-Free — Yes

Fiches techniques et ressources

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