EPM570T10015 vs EPM570GT100I5 Comparaison

Comparaison détaillée côte à côte de EPM570T10015 par Altera et EPM570GT100I5 par Altera. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Comparaison des spécifications

Paramètre EPM570T10015 EPM570GT100I5
Marque Altera Altera
Catégorie FPGA & CPLD FPGA & CPLD
Statut du cycle de vie Actif Actif
Statut du stock In Stock In Stock
Prix unitaire (USD) $7,95 $4,95
Device Family MAX II —
Logic Elements 570 —
Macro Cells 440 —
User Flash Memory 8 Kbits 8 Kbits
Maximum User I/O Pins 76 76
Boîtier TQFP-100 (T100) 14 x 14 mm 100-pin TQFP (14x14 mm, 0.5 mm pitch)
Pin-to-Pin Delay (tPD) 15 ns (commercial/industrial speed grade) —
Propagation Delay [DATA_NEEDED: detailed tPD/tCO/tSU datasheet values] —
Supply Voltage - Core (VCCINT) 3.3 V (2.5 V variants exist in MAX II family) —
Supply Voltage - I/O (VCCIO) 1.5 V / 1.8 V / 2.5 V / 3.3 V (multi-volt I/O) —
Plage de température de fonctionnement -40 °C to +85 °C (industrial) —
Configuration Memory On-chip flash (non-volatile, instant-on) —
Programming Interface JTAG (IEEE 1149.1 / IEEE Std 1532) —
Supported I/O Standards LVTTL, LVCMOS, PCI, SSTL (per pin) —
Process Technology 0.18 µm —
Statut RoHS [DATA_NEEDED: RoHS compliance status] Compliant
Niveau MSL [DATA_NEEDED: moisture sensitivity level] —
Series — MAX II
Logic Elements (LE) — 570
Macrocells — 440
Propagation Delay (tPD) — 5.4 ns (typ)
Internal Supply Voltage (VCCINT) — 1.71 V to 1.89 V
User I/O Voltage (VCCIO) — 1.5 V / 1.8 V / 2.5 V / 3.3 V (MultiVolt)
Programmability — In-System Programmable (ISP) via JTAG, non-volatile flash
Configuration Time — Instant-On (< 1 ms, no external PROM required)
Température de fonctionnement — -40 C to +100 C (Industrial, "I5")
Type de montage — Surface Mount (Gull-wing leads)
Typical Active Current — [DATA_NEEDED: typical active ICC]
Speed Grade — GT (fast)
JTAG Support — IEEE 1149.1 boundary scan
Global Clock Networks — 4

Fiches techniques et ressources

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