EPM9560RI240-15N vs EPM9560RC240-15N Comparaison

Comparaison détaillée côte à côte de EPM9560RI240-15N par Intel et EPM9560RC240-15N par Altera. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Comparaison des spécifications

Paramètre EPM9560RI240-15N EPM9560RC240-15N
Marque Intel Altera
Catégorie FPGA & CPLD FPGA & CPLD
Statut du cycle de vie Obsolete NRND
Statut du stock In Stock In Stock
Prix unitaire (USD) $0,00 $27,85
Device Type EEPROM-based Complex Programmable Logic Device (CPLD) —
Logic Family MAX 9000 (Multiple Array MatriX) CMOS (EEPROM-based)
Macrocells 560 560
Flip-Flops 772 —
Usable Gates 12,000 12,000
User I/O Pins 216 —
Boîtier 240-pin RQFP (PowerQuad Flat Pack) RQFP-240 (240-pin Plastic Quad Flat Pack)
Pin-to-Pin Propagation Delay 15 ns —
Internal Frequency 145 MHz —
Tension d'alimentation 5.0 V 5.0 V
I/O Voltage Compatibility 3.3 V or 5.0 V configurable —
Configuration Memory EEPROM (non-volatile, in-system programmable) —
JTAG Interface IEEE 1149.1 (JTAG) boundary scan —
Plage de température de fonctionnement -40 C to +85 C (industrial) —
Type de montage Surface Mount Surface Mount
Statut RoHS RoHS3 Compliant [DATA_NEEDED: RoHS compliance - older Altera RQFP part]
Moisture Sensitivity Level MSL 3 (168 hours) —
Manufacturer Standard Lead Time 1-7 days (distributor stock) —
Series — MAX 9000
Family — MAX 9000 (third-generation Multiple Array MatriX)
Logic Array Blocks (LABs) — 35
Maximum User I/O Pins — 216
Pin-to-Pin Propagation Delay (tPD) — 15 ns
Internal Counter Frequency (fCNT) — 145 MHz
Global Setup Time (tFSU) — [DATA_NEEDED: tFSU for -15 grade]
Clock-to-Output Time (tFCO) — [DATA_NEEDED: tFCO for -15 grade]
Programmability — In-system programmable (IEEE 1532/JTAG)
Boundary-Scan Test — JTAG (IEEE 1149.1)
Température de fonctionnement — 0C to +70C (Commercial)

Fiches techniques et ressources

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