EPM7128SQC100-10 vs EPM7128SQC100-7N Comparação

Comparação detalhada lado a lado de EPM7128SQC100-10 por Altera e EPM7128SQC100-7N por Intel. Compare especificações principais, parâmetros elétricos, encapsulamento, status do ciclo de vida, preços e disponibilidade para determinar o melhor componente para os requisitos do seu projeto.

Comparação de especificações

Parâmetro EPM7128SQC100-10 EPM7128SQC100-7N
Marca Altera Intel
Categoria FPGA & CPLD FPGA & CPLD
Status do ciclo de vida Obsolete Obsolete
Status do estoque In Stock In Stock
Preço unitário (USD) $9,85 $7,10
Family MAX 7000S MAX 7000S
Device Type CPLD (Complex Programmable Logic Device) CPLD - Complex Programmable Logic Device
Macro Cells 128 —
Logic Elements / Gates 2,500 usable gates —
Maximum User I/O 84 —
Logic Array Blocks (LABs) 16 —
Maximum Operating Frequency 100 MHz —
Pin-to-Pin Logic Delay (tPD) 10 ns —
Tensão de alimentação 5 V —
Process Technology 5V CMOS, EEPROM-based 0.30 µm CMOS EEPROM
Programmability In-System Programmable (ISP) via JTAG —
Encapsulamento 100-pin PQFP (Plastic Quad Flat Pack) 100-pin PQFP (QFP-100)
Temperatura de operação 0C to +70C (commercial) 0C to +70C (commercial)
Tipo de montagem Surface Mount —
Status RoHS [DATA_NEEDED: rohs_status] Compliant (lead-free 'N' suffix)
Program Memory Type — EEPROM
Number of Macrocells — 128
Number of Logic Array Blocks — 8
Number of Global Clocks — 2
Product Terms per Macrocell — 32
Usable Gates — 2,500
System Gates — 5,000 (max)
Maximum User I/Os — 84
Pin-to-Pin Delay (tPD) — 7.5 ns
Counter Speed — 175.4 MHz
In-System Programmability — Yes (IEEE 1149.1 JTAG)
Operating Voltage (Core) — 5.0 V
I/O Standard Support — multiVolt (2.5V, 3.3V, 5.0V)
Security Bit — Programmable (one per device)

Fichas técnicas e recursos

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