EP1810LC-25 vs EP1810JI-35 Сравнение

Подробное сравнение бок о бок EP1810LC-25 от Altera и EP1810JI-35 от Intel. Сравните ключевые характеристики, электрические параметры, упаковку, статус жизненного цикла, цены и наличие, чтобы выбрать лучший компонент для ваших требований.

Сравнение характеристик

Параметр EP1810LC-25 EP1810JI-35
Бренд Altera Intel
Категория FPGA & CPLD FPGA & CPLD
Статус жизненного цикла Obsolete Obsolete
Наличие In Stock In Stock
Цена за единицу (USD) $8,40 $18,60
Product Family Altera Classic EPLD —
Part Number EP1810LC-25 —
Macrocells 48 48
Propagation Delay (tPD) 25 ns —
Dedicated Inputs 12 48
I/O Pins 48 —
External Clock Inputs 4 —
Supply Voltage (VCC) 5 V (TTL-compatible) —
Operating Mode Turbo-only (no slow-power mode) —
Корпус 68-pin JLCC (J-leaded ceramic chip carrier) 28-pin JLCC (J-leaded ceramic, windowed)
Package Code LC = 68-pin JLCC —
Тип монтажа Surface Mount Through-Hole (J-lead)
Technology CMOS EPLD (erasable programmable logic device) —
Programmable Interconnect Global + Local buses —
Programming Method Altera Classic programmer + MAX+PLUS II legacy flow —
Статус жизненного цикла Obsolete (legacy Altera Classic family) —
Статус RoHS [DATA_NEEDED: RoHS compliance not confirmed in legacy datasheet] [DATA_NEEDED: RoHS compliance for ceramic windowed JLCC]
Рабочая температура [DATA_NEEDED: temperature grade for LC package] -40C to +85C (Industrial)
Device Family — Classic EPLD
Logic Array Blocks — 8 LABs of 16 macrocells
Pin-to-Pin Propagation Delay (tPD) — 35 ns
Speed Grade — -35
Process Technology — CMOS EPROM (UV-erasable)
Напряжение питания — 5 V (typical classic EPLD)
Programmability — UV-erase, windowed for lab reprogram
Уровень MSL — [DATA_NEEDED: MSL rating]
Programming Interface — JEDEC fuse file via legacy programmer

Даташиты & ресурсы

Все товары Создать BOM Запросить цену