Semiconductor News · Tóm tắt tìm kiếm

What ChipAgents and NVIDIA's Build-A-Chip-Bench means for autonomous RTL-to-GDS tooling

ChipAgents and NVIDIA launch Build-A-Chip-Bench to score end-to-end digital chip design. Only ~10% of agent runs hit PPA targets, exposing the gap to tapeout-ready AI.

Đã công bố Cập nhật 4 đọc ít nhất ✓ Sẵn sàng AI Chia sẻ

TL;DR — ba câu

  • ChipAgents and NVIDIA introduced Build-A-Chip-Bench, scoring AI agents from specification through verified GDS across 11 design stages. (S1)
  • Initial evaluations: about 40% functional-verification pass rate versus about 10% PPA-target pass rate on tested agents. (S1)
  • Existing RTL benchmarks stop before place-and-route, missing timing, area, power and physical-verification failures. (S1)

Được lấy từ key_takeaways (thực tế, tối đa 3 mục). Thực tế và phân tích được đánh dấu riêng biệt

What ChipAgents and NVIDIA's Build-A-Chip-Bench means for autonomous RTL-to-GDS tooling — Semiconductor News news briefEditorial cover for a Semiconductor News brief. Chip motif; headline "What ChipAgents and NVIDIA's Build-A-Chip-Bench means for autonomous RTL-to-GDS tooling". No reported key numbers on this brief, so no number strip is drawn. 1 cited source. Static cover (no animation).SEMICONDUCTOR NEWS · NEWS BRIEFWhat ChipAgents and NVIDIA'sBuild-A-Chip-Bench means for autonomousRTL-to-GDS toolingXAIPART
Cover image generated from data already shown on this page: the category motif, the headline, and reported key numbers. No decorative illustration; no third-party image.

Bạn đã đến từ câu trả lời của AI — này là bản gốc có thể kiểm chứng

Một tóm tắt AI có thể đã bỏ qua cơ sở cho các luận điểm của nó. Dự báo ban đầu, các phần bị ảnh hưởng và mỗi dẫn chứng đều có trên trang này, mỗi cái có thể truy nguồn.

Dự báo XAIPART

Tóm tắt này mang theo một dự đoán có thể bị chứng minh

Các phần bị ảnh hưởng

Không có khớp catalog cho câu chuyện này — không có gì được hiển thị thay vì suy đoán một khớp.

Reported by Semiconductor Digest on 2026-10-15. Summarized and analyzed by XAIPART Editorial.

What happened

ChipAgents, an agentic AI platform for semiconductor engineering, introduced Build-A-Chip-Bench, a benchmark developed in collaboration with NVIDIA to measure whether AI agents can carry a digital chip-design task from specification through physical implementation and verified GDS.S1

The benchmark covers the full chip-design flow: architecture, microarchitecture, RTL, functional verification, logic synthesis, floor planning, placement, clock-tree synthesis, routing, timing and power signoff, and physical verification.S1 Existing RTL-only benchmarks, the source notes, typically stop before downstream physical implementation, where an RTL design can still fail timing, exceed area or power budgets, fail to route, or produce physical-design violations.S1

Initial evaluations report that tested agents passed functional verification on about 40% of tasks on average, while only approximately 10% met the required physical performance, power and area (PPA) targets.S1 William Wang, Founder and CEO of ChipAgents, said the benchmark gives the industry a way to measure the gap between current agents and chip-design superintelligence.S1 Tim Costa, vice president and general manager of industrial and computational engineering at NVIDIA, said the benchmark gives developers a clear view of where reasoning and tool use must improve.S1

The benchmark was developed by Surya Gunukula, Jerry Yicheng Wang and Kevin Zhang, with technical expertise from NVIDIA. Full task details, methodology and results are hosted at chipagents.ai/research/build-a-chip-bench.S1

MetricReported valueSource
Functional verification pass rate (initial evaluations)~40% of tasks on average[S1]
PPA target pass rate (initial evaluations)~10%[S1]
Benchmark authorsSurya Gunukula, Jerry Yicheng Wang, Kevin Zhang (plus NVIDIA technical expertise)[S1]
Flow coverageArchitecture to physical verification, 11 stages listed[S1]

Background timeline

  1. - ChipAgents and NVIDIA introduced Build-A-Chip-Bench, an end-to-end digital chip-design benchmark.[S1]
  2. No prior milestones disclosed by the source.

XAIPART take

Technical impact

The benchmark reframes "AI for EDA" from RTL generation into a closed-loop metric that requires an agent to drive synthesis, place-and-route, timing signoff and physical verification together. XAIPART analysis For design teams, this means tool-vendor and in-house evaluation scripts will need to score PPA outcomes, not just simulation coverage, when trialing agentic RTL assistants. XAIPART analysis The roughly 10% PPA pass rate the source reports suggests today's agents are still useful as RTL drafting aides rather than tapeout drivers, so engineering judgment on timing closure and constraints remains on the critical path. XAIPART analysis

Market impact

NVIDIA lending technical expertise to a public benchmark signals continued positioning around agentic silicon engineering workflows adjacent to its CUDA and DGX footprint. XAIPART analysis For EDA incumbents and RTL-IP vendors, a shared, vendor-neutral PPA-aware yardstick raises the bar on marketing claims: procurement can now ask any "AI copilot" supplier for its score on Build-A-Chip-Bench rather than rely on demo videos. XAIPART analysis The source did not disclose licensing terms, commercial bundling with NVIDIA tools, or pricing of any ChipAgents product, so near-term lead-time and pricing effects on component sourcing are unclear. XAIPART analysis

Action

Design-in leads should download the methodology from chipagents.ai/research/build-a-chip-bench and replicate one representative block internally before greenlighting a multi-month AI-EDA pilot. XAIPART analysis Procurement should add a line item to vendor RFQs asking for Build-A-Chip-Bench-style PPA pass rates on a customer-supplied design, and reject claims supported only by RTL simulation results. XAIPART analysis

XAIPART Forecast

XAIPART expects that if Build-A-Chip-Bench is run by Q3 2026, the average PPA pass rate of leading public agentic EDA tools on the published task suite will remain below 25% by Q2 2027; if published rates climb above 25% by 2027-06-30, this forecast is wrong. XAIPART analysis

Facts are as reported by the cited source. The design-in, sourcing and forward-looking statements above are XAIPART's analysis, not the source's claims. The 40% and 10% pass-rate figures are initial evaluations from ChipAgents and are not yet independently replicated; commercial terms, IP licensing and any NVIDIA tool bundling were not disclosed by the source.

Corrections: none at publication. This brief will be updated with a timestamp if the source corrects its report.

Các lựa chọn và chu kỳ sống

Các lựa chọn trên tệp — phạm vi thư mục, không phải là bảng xếp hạng thị trường
PhầnQuan hệChu kỳ sốngCơ sở
— Không có tùy chọn nào trong tệp CẦN DỮ LIỆU — Yêu cầu match_type trước khi bất kỳ nhãn tiền thân nào có thể xuất hiện

“Tiền thân” và các nhãn thay thế chỉ đến từ một loại khớp đã được ghi lại, trạng thái chu kỳ sống hoặc văn bản nguồn. Khi không có khớp nào được ghi lại, không có nhãn nào được hiển thị. Các danh sách của chúng tôi không phải là một tham chiếu thị trường.

Điều gì cần xem

Dự báo có thể chứng minh — ngưỡng, cửa sổ và trạng thái hiện tại. Các dự báo bị bác bỏ vẫn hiển thị.
Đề xuấtCấp độBởiTrạng thái
XAIPART expects that if Build-A-Chip-Bench is run by Q3 2026, the average PPA pass rate of leading public agentic EDA tools on the published task suite will remain below 25% by Q2 2027 published rates climb above 25% by 2027-06-30 Pending

Các dự báo sai vẫn được giữ hiển thị và đánh dấu. Chúng tôi không xóa chúng.

Bức tranh cạnh tranh

  • 24271 danh sách trực tiếp trong loại này trên XAIPART
  • 111 các nhà sản xuất đại diện
  • 71 các nhà sản xuất được nhắc đến trong kho lưu trữ tin tức của chúng tôi trong 30 ngày qua

Số lượng phản ánh chỉ catalog của XAIPART — chúng không phải là thị phần.

Các phần bị ảnh hưởng

Không có khớp catalog. Câu chuyện này không khớp với bất kỳ linh kiện nào được liệt kê trên XAIPART hiện tại. Chúng tôi không suy luận khớp và chúng tôi không hiển thị danh sách chờ.

Đây ở đâu trong câu chuyện

Event chain · as of 2026-10-26T17:30:34+08:00 · showing 6 of 10 briefs · nodes link to published articles on this site.
Event chain — nvidia+semiconductor-newsChain nodes: 2026-10-07 NVIDIA's supply commitments jumped to $279 billion, mostly for memory, and Morgan Stanley estimates it has reserved 37.3% of 2027 HBM supply - tightening the market for everyone else.; 2026-10-08 Microsoft priced the Surface Laptop Ultra at $2,599-$5,899 with October 16 shipping, debuting NVIDIA's RTX Spark N1X in a 15-inch mini-LED chassis and a breakaway USB-C port.; 2026-10-09 AI demand is no longer gated by GPU supply. Power, HBM, CoWoS-L, GaN and CPO are the new constraints designers and buyers must plan around.; 2026-10-11 3D InCites feature argues grating-less and reduced-grating laser designs may cut thermal stress in hyperscale transceivers—but only if matched DFB baseline data, Telcordia GR-468 aging, and SMSR evidence are produced.; 2026-10-11 IEEE Spectrum reports inference has overtaken training as the AI industry focus, driving memory-centric silicon designs and unusual chip alliances.; 2026-10-14 NVIDIA pairs a 20-core Grace CPU with a 6,144-CUDA Blackwell iGPU under the RTX Spark name, backed by Microsoft and game studios for Arm64 translation and kernel-mode anti-cheat parity.. As of 2026-10-26T17:30:34+08:00. Open forecast: NVIDIA's supply commitments jumped to $279 billion, mostly for memory, a — pending Open forecast: Microsoft priced the Surface Laptop Ultra at $2,599-$5,899 with October — pending.2026-10-07NVIDIA's supply coour brief ↗2026-10-08Microsoft priced tour brief ↗2026-10-09AI demand is no loour brief ↗2026-10-113D InCites featureour brief ↗2026-10-11IEEE Spectrum repoour brief ↗2026-10-14NVIDIA pairs a 20-our brief ↗Open forecast: NVIDIA's supply commitments jumped to $279 billion, mostly for memory, a — pendingOpen forecast: Microsoft priced the Surface Laptop Ultra at $2,599-$5,899 with October — pending
  1. nvidia-s-279b-supply-commitments-and-2027-hbm-lock-up-what-buyers-should-know2026-10-07
  2. microsoft-surface-laptop-ultra-priced-from-2-599-what-rtx-spark-n1x-skus-mean-for-buyers2026-10-08
  3. ai-chip-bottlenecks-shift-downstream-what-800v-cowos-l-and-hbm-sellouts-mean-for-design-in2026-10-09
  4. dfb-laser-alternatives-under-the-microscope-for-ai-scale-optical-reliability2026-10-11
  5. ai-inference-shift-reshapes-accelerator-roadmaps-and-memory-sourcing2026-10-11
  6. nvidia-rtx-spark-superchip-locked-to-windows-11-aaa-day-one-with-dlss-5-and-anti-cheat-support2026-10-14
  1. NVIDIA's supply commitments jumped to $279 billion, mostly for memory, and Morgan Stanley estimates it has reserved 37.3% of 2027 HBM supply - tightening the market for everyone else. trade
  2. Microsoft priced the Surface Laptop Ultra at $2,599-$5,899 with October 16 shipping, debuting NVIDIA's RTX Spark N1X in a 15-inch mini-LED chassis and a breakaway USB-C port. trade
  3. AI demand is no longer gated by GPU supply. Power, HBM, CoWoS-L, GaN and CPO are the new constraints designers and buyers must plan around.
  4. 3D InCites feature argues grating-less and reduced-grating laser designs may cut thermal stress in hyperscale transceivers—but only if matched DFB baseline data, Telcordia GR-468 aging, and SMSR evidence are produced.
  5. IEEE Spectrum reports inference has overtaken training as the AI industry focus, driving memory-centric silicon designs and unusual chip alliances. trade
  6. NVIDIA pairs a 20-core Grace CPU with a 6,144-CUDA Blackwell iGPU under the RTX Spark name, backed by Microsoft and game studios for Arm64 translation and kernel-mode anti-cheat parity. trade
  7. ChipAgents and NVIDIA launch Build-A-Chip-Bench to score end-to-end digital chip design. Only ~10% of agent runs hit PPA targets, exposing the gap to tapeout-ready AI. trade
  8. dashdogy's Universal MFG Unlocker v1.5.0 enables NVIDIA's new Preset C on Ampere cards, but RTX 30 numbers and image-quality trade-offs remain unverified. trade
  9. NVIDIA pairs with seven partners to lift substrate output 2.5x, Amkor interposer wafer capacity over 300%, and double test capacity by 2027; ramps run into 2028. capacity trade
  10. NVIDIA lowered Vera Rubin HBM4 and NVLink targets, affecting peak memory bandwidth, interconnect capacity, and procurement planning for rack-scale deployments. trade

Chuỗi được xây dựng chỉ từ các tóm tắt được công bố — một nút không có tóm tắt thì không được vẽ.

Áp lực chi phí theo chiều

Source: FRED · Generated · reference output z and composite are algorithm outputs, not a fetch snapshot

Cost pressure by dimension — composite stateDiverging bars for three dimensions around a zero midpoint. Input Cost has no reading; Supply Demand z -1.4711, notable; Fx Energy z 0.1754, neutral. Composite index -9.7, band neutral.0Input costno readingSupply/demandz −1.4711 · notable46 dFX & energyz +0.1754 · neutral5 dcomposite −9.7 · neutral−100 · −40 · −15 · 0 · +15 · +40 · +100
Underlying values — copyable for verification.
DimensionFRED series IDUnitLagAs of
Input costPCOPPUSDM, PALUMUSDM, PNICKUSDMUSD/mt52 d
Supply/demandPCU334413334413, IPG3344Sindex(1982=100) / index(2017=100)46 d
FX & energyDEXCHUS, DCOILBRENTEU, DHHNGSPrate / USD/bbl / USD/MMBtu5 d

No free authoritative interface for: gold · silver · rare earth · polysilicon · lithium carbonate · market share — listed rather than approximated.

Cách sản xuất điều này

Xử lý chứng cứ — thu thập, nguồn xác thực, mô hình và cửa
Vết kiểm tra cho brief này
Source fetched Semiconductor Digest · www.semiconductor-digest.com · 4,019 chars · fetch status success
Source sanity (S1) ok — passed before any model call (no s1_ block recorded)
Model / prompt MiniMax-M3 · prompt Blog Agent - News Summary (v2.8-final) · 6,518 tokens · 14.6s · run completed
Gate verdict pass · 6/6 applicable checks passed · spec v2.9 · C10 ratio 0.052479 · C10 rounds 0
Time contract 1 <time datetime> values in this brief — 0 violations (+08:00 or date-only)

Mỗi hàng trên đều được sản xuất bởi pipeline, không phải viết bằng tay.

Điểm số biên tập

Kết quả của cửa số xác định — pure PHP, không có sự tham gia của mô hình trong quyết định
Phân tích điểm số cửa 6 kiểm tra áp dụng 6đã qua: 100 phần trăm. No hold items or mandatory failures. Gate spec: v2.9 (S0 + S1 + C1–C20) · Source affinity (C20): 0.8571. Kiểm tra áp dụng đã通过了 6 / 6 = 100% · kết luận: pass No hold items or mandatory failures Gate spec: v2.9 (S0 + S1 + C1–C20) · Source affinity (C20): 0.8571 Cổng quyết định việc công bố. Điểm số kiểm tra độc lập chỉ có tính chất cố vấn.
Phát hiện lỗi? Hãy cho chúng tôi biết điều gì sai — điều chỉnh được xuất bản cùng với văn bản gốc và được ghi lại. Chúng tôi không chỉnh sửa bài viết một cách im lặng.

Bình luận

Trở thành người đầu tiên bình luận.

Nguồn

  1. ChipAgents, NVIDIA Launch Benchmark for Autonomous Chip Design — https://www.semiconductor-digest.com/chipagents-nvidia-launch-benchmark-for-autonomous-chip-design/ · rss · truy cập

Các sự kiện được đánh dấu S1/S2 và truy nguyên đến nguồn liên kết. Các đoạn văn có nhãn phân tích là lý do của XAIPART riêng, được giữ tách biệt khỏi các thực tế đã báo cáo. Các liên kết nguồn được theo dõi thay vì nofollow — ghi nhận là cố ý.