EPM3128ATC100-7 vs EPM3128ATC100-10N So sánh

So sánh chi tiết song song của EPM3128ATC100-7 bằng Intel và EPM3128ATC100-10N bằng Altera. So sánh các thông số quan trọng, thông số điện tử, gói gọn, trạng thái vòng đời, giá cả và khả năng cung cấp để xác định linh kiện tốt nhất cho yêu cầu thiết kế của bạn.

So sánh thông số kỹ thuật

Tham số EPM3128ATC100-7 EPM3128ATC100-10N
Thương hiệu Intel Altera
Danh mục FPGA & CPLD FPGA & CPLD
Trạng thái vòng đời Obsolete NRND
Family MAX 3000A MAX 3000A
Device Type CPLD (Complex Programmable Logic Device) —
Macro Cells 128 128
Typical Gates 2500 —
User I/Os 80 —
Logic Elements / LABs 4 Logic Array Blocks (LABs) —
Propagation Delay (tPD) 7.5 ns 10 ns
Counter Frequency (fCNT) 129.9 MHz —
Supply Voltage (VCCINT) 3.3 V —
I/O Voltage Tolerance 5.0 V tolerant inputs —
Programming Technology EEPROM (non-volatile, in-system programmable) —
ISP Standard IEEE Std. 1532 (JTAG) —
Hộp 100-pin TQFP, 14x14 mm, 0.5 mm pitch 100-pin TQFP (14 x 14 x 1.0 mm)
Nhiệt độ hoạt động 0C to +70C (Commercial) 0 °C to +70 °C (commercial)
Speed Grade -7 (fastest grade in family) —
Process Technology CMOS EEPROM —
Trạng thái RoHS [DATA_NEEDED: RoHS status] Compliant
Lead-Free [DATA_NEEDED: lead-free status] Yes
Product Type — CPLD (Complex Programmable Logic Device)
Usable Gates — 2500
Number of I/O — 80
Logic Elements / Blocks — 8 LABs (16 macrocells each)
Maximum Internal Frequency (fMAX) — 98 MHz
Supply Voltage VCCINT — 3.3 V
I/O Bank Voltage VCCIO — 3.3 V or 2.5 V (selectable)
Configuration Memory — CMOS EEPROM (non-volatile, instant-on)
In-System Programming — IEEE Std. 1532-compliant ISP via JTAG
Kiểu lắp đặt — Surface Mount
Cấp MSL — 3 (per JEDEC J-STD-020)

Hồ sơ kỹ thuật & Tài nguyên

Xem tất cả sản phẩm Tạo BOM Yêu cầu báo giá