EPM5032JC25 vs EPM5064JC Vergleich

Detaillierter Direktvergleich von EPM5032JC25 von Altera und EPM5064JC von Altera. Vergleichen Sie die wichtigsten Spezifikationen, elektrischen Parameter, Gehäuse, Lebenszyklusstatus, Preise und Verfügbarkeit, um das beste Bauteil für Ihre Designanforderungen zu ermitteln.

Spezifikationsvergleich

Parameter EPM5032JC25 EPM5064JC
Marke Altera Altera
Kategorie FPGA & CPLD FPGA & CPLD
Lebenszyklusstatus Obsolete Obsolete
Lagerstatus In Stock In Stock
Stückpreis (USD) $23,95 $7,10
Family MAX 5000 MAX 5000
Device EPM5032 —
Logic Elements 32 macrocells —
Propagation Delay (tPD) 25 ns —
Maximum Internal Frequency 62.5 MHz —
Product Terms 320 —
Flip-Flops 32 —
Dedicated Inputs 7 —
Bidirectional I/O Pins 16 —
Total Inputs to Array 24 —
Anzahl der Ausgänge 16 —
Architecture PAL-type macrocells with global Programmable Interconnect Array (PIA) —
Technology CMOS EPROM, UV-erasable (windowed) / OTP —
Versorgungsspannung 5 V (TTL-level I/O) —
Gehäuse 28-pin PLCC (JC) 68-pin PLCC (JEDEC)
Montageart Surface Mount Surface Mount (socketed)
RoHS-Status [DATA_NEEDED: RoHS status] [DATA_NEEDED: RoHS compliance]
Device Type — EPLD (Erasable PLD)
Macrocells — 64
Usable Gates — 1,250 (approx.)
Logic Array Inputs — 36
Logic Array Outputs — 64
Supply Voltage (VCC) — 5 V (typical, 4.75 V - 5.25 V range)
I/O Logic Level — TTL / CMOS compatible
Configuration Memory — EPROM (UV-erasable window or OTP)
Betriebstemperatur — [DATA_NEEDED: operating temperature grade]
Pin-to-Pin Delay (tPD) — [DATA_NEEDED: specific tPD grade value]
Maximum Frequency (fMAX) — [DATA_NEEDED: fCNT grade value]
Lead-Free — [DATA_NEEDED: lead-free status]
MSL-Level — [DATA_NEEDED: MSL rating]
Programming Tool — Altera MAX+PLUS II / Quartus II (legacy device support)

Datenblätter & Ressourcen

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