EPM3512AFC256-10N vs EPM3512AFC256-20 Comparación

Comparación detallada lado a lado de EPM3512AFC256-10N por Altera y EPM3512AFC256-20 por Altera. Compare las especificaciones clave, los parámetros eléctricos, el encapsulado, el estado del ciclo de vida, los precios y la disponibilidad para determinar el mejor componente para los requisitos de su diseño.

Comparación de especificaciones

Parámetro EPM3512AFC256-10N EPM3512AFC256-20
Marca Altera Altera
Categoría FPGA & CPLD FPGA & CPLD
Estado del ciclo de vida Obsolete Obsolete
Estado del stock In Stock In Stock
Precio unitario (USD) $43,22 $9,75
Family MAX 3000A MAX 3000A
Macrocells 512 512
Usable Gates 10000 —
User I/O Pins 208 —
Logic Array Blocks (LABs) [DATA_NEEDED: number of LABs] —
Operating Frequency (fMAX) [DATA_NEEDED: fMAX MHz] —
Pin-to-Pin Delay (tPD) 10 ns —
Setup Time (tSU) 4.5 ns —
VCCINT (Core Supply) 3.3 V —
VCCIO (I/O Supply) 3.3 V or 2.5 V —
Technology CMOS EEPROM-based, non-volatile —
Operating Temperature (Commercial) 0 C to +70 C —
Encapsulado 256-ball FBGA (17 mm x 17 mm) 256-ball FBGA (Fine-pitch BGA)
ISP Interface IEEE Std. 1149.1 JTAG, IEEE Std. 1532 —
Tipo de montaje Surface Mount (BGA) Surface Mount
Nivel MSL [DATA_NEEDED: MSL rating] [DATA_NEEDED: MSL moisture sensitivity level]
Estado RoHS [DATA_NEEDED: RoHS status] [DATA_NEEDED: RoHS compliance status]
Typical Usable Gates — 10,000
Speed Grade — -20 (20 ns tPD)
Recuento de pines — 256
Operating Voltage (VCCINT) — 3.3 V (3.0 V to 3.6 V)
I/O Voltage (VCCIO) — 2.5 V or 3.3 V (5.0 V tolerant inputs)
I/O Standards — LVTTL, LVCMOS, 2.5 V, 3.3 V, 5.0 V tolerant
Program Memory Type — EEPROM (non-volatile)
In-System Programmability — Yes (JTAG IEEE 1149.1)
JTAG Support — Yes (boundary-scan + ISP)
Temperatura de funcionamiento — [DATA_NEEDED: operating temperature range]
Configuration Memory — Internal EEPROM

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