EPM9560RC208-18 vs EPM9560RC208-20 Comparación

Comparación detallada lado a lado de EPM9560RC208-18 por Altera y EPM9560RC208-20 por Intel. Compare las especificaciones clave, los parámetros eléctricos, el encapsulado, el estado del ciclo de vida, los precios y la disponibilidad para determinar el mejor componente para los requisitos de su diseño.

Altera
EPM9560RC208-18 EPM9560RC208-18 - MAX 9000 CPLD 560 Macro Cells 5V | Altera

EPM9560RC208-18 - MAX 9000 CPLD 560 Macro Cells 5V | Altera

EPM9560RC208-18 ✗ Fin de vida

Comparación de especificaciones

Parámetro EPM9560RC208-18 EPM9560RC208-20
Marca Altera Intel
Categoría FPGA & CPLD FPGA & CPLD
Estado del ciclo de vida Fin de vida Obsolete
Estado del stock In Stock In Stock
Precio unitario (USD) $0,00 $0,00
Device Family MAX 9000 (EPM9560) MAX 9000 (EPM9560)
Logic Type EEPROM-based Complex Programmable Logic Device (CPLD) —
Usable Gates 12,000 gates 12,000
Macrocells 560 macrocells 560
Propagation Delay (tPD) 18 ns (speed grade -18) —
Maximum Operating Frequency 117.6 MHz (family -15 grade reference) —
Tensión de alimentación 5 V 5.0 V
I/O Voltage Compatibility 3.3 V or 5 V —
User I/O Lines 149 I/O lines —
Flip-Flops 772 flip-flops 772
Encapsulado 208-pin RQFP (Power Quad Flat Pack) 208-pin RQFP (28x28 mm)
Package JESD-30 Code S-PQFP-G208 —
Tipo de montaje Surface Mount Surface Mount
Configuration Memory EEPROM (non-volatile, no external config PROM) —
Technology CMOS —
Temperatura de funcionamiento [DATA_NEEDED: operating temperature range] 0C to +70C (commercial)
Estado RoHS [DATA_NEEDED: RoHS status] [DATA_NEEDED: RoHS status]
Estado del ciclo de vida EOL / mature (per Altera product discontinuance notice) —
Logic Array Blocks — 35
User I/O Pins — 153
Pin-to-Pin Delay (tPD) — 20 ns
Frecuencia de reloj máxima — 100 MHz
Configuration Technology — EEPROM (non-volatile)
In-System Programmability — Yes, via IEEE Std. 1149.1 JTAG
I/O Standards — 5.0 V TTL/CMOS compatible
Nivel MSL — [DATA_NEEDED: MSL level]

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