5M80ZT100A5N vs 5M80ZT100I5N Comparaison

Comparaison détaillée côte à côte de 5M80ZT100A5N par Altera et 5M80ZT100I5N par Intel. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Comparaison des spécifications

Paramètre 5M80ZT100A5N 5M80ZT100I5N
Marque Altera Intel
Catégorie FPGA & CPLD FPGA & CPLD
Statut du cycle de vie Actif Actif
Statut du stock In Stock In Stock
Prix unitaire (USD) $1,85 $7,37
Family MAX V MAX V CPLD
Macro Cells 64 —
Logic Elements / LABs 8 Logic Array Blocks (LABs) —
Maximum User I/O 80 (in TQFP-100 package) —
Pin-to-Pin Propagation Delay (tPD) 7.5 ns —
Maximum Internal Frequency (fMAX) 118.3 MHz —
Core Supply Voltage (VCCINT) 1.8 V 1.71 V to 1.89 V (1.8 V typical)
I/O Bank Supply Voltage (VCCIO) 1.2 V / 1.5 V / 1.8 V / 2.5 V / 3.3 V (multi-voltage banks) —
User Flash Memory (UFM) 8 Kbits (typical for MAX V 64-macrocell device) —
Configuration Memory Non-volatile, on-chip flash Internal non-volatile flash (instant-on)
Programming Interface JTAG (IEEE 1149.1 / IEEE 1532) —
Température de jonction en fonctionnement -40 C to +125 C (automotive/industrial grade) —
Boîtier 100-pin TQFP (T100) TQFP-100 (100 pins, 0.5 mm pitch)
Type de montage Surface Mount Surface Mount
Niveau MSL 3 (per JEDEC J-STD-020) MSL3 (per JEDEC J-STD-020)
Statut RoHS Compliant Compliant
Automotive Qualification AEC-Q100 (A5N suffix) —
Supply Current (typical) [DATA_NEEDED: Icc typical] —
Global Clock Networks 4 —
Lead-Free / Halogen-Free Yes / Yes (per Altera lead-free roadmap) —
Logic Elements (LE) — 80
Macrocells (approx.) — 160
User I/O Pins — 64
Pin-to-Pin Logic Delay (tPD) — 7.5 ns
I/O Supply Voltage (VCCIO) — 1.2 V / 1.5 V / 1.8 V / 2.5 V / 3.3 V
Operating Temperature (Industrial) — -40 °C to +100 °C
UFM (User Flash Memory) — Up to 8 Kbits user-accessible
JTAG / ISP — IEEE 1149.1 boundary-scan + in-system programming

Fiches techniques et ressources

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