EP20K400FI672-3V vs EP20K400FC672-3 Comparaison

Comparaison détaillée côte à côte de EP20K400FI672-3V par Intel et EP20K400FC672-3 par Altera. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Comparaison des spécifications

Paramètre EP20K400FI672-3V EP20K400FC672-3
Marque Intel Altera
Catégorie FPGA & CPLD FPGA & CPLD
Statut du cycle de vie Obsolete Obsolete
Statut du stock In Stock In Stock
Prix unitaire (USD) $285,00 $138,00
Family APEX 20K (EP20K400) APEX 20K
Logic Elements 16,640 —
Maximum Gates 400,000 —
Typical Gates [DATA_NEEDED: typical gates value] —
Embedded Memory (bits) 212,992 —
Maximum User I/O 502 —
Dedicated Inputs 6 —
Total User I/O + Dedicated Inputs 496 + 6 (variant dependent) —
Fréquence d'horloge maximale 714.2 MHz —
Speed Grade -3 (faster) -3 (commercial fastest)
Core Voltage (VCCINT) 2.5 V nominal (2.375 V to 2.625 V) —
Process Technology 0.18 µm CMOS, 4 metal layers 0.22 µm CMOS
Boîtier 672-ball FineLine BGA (BBGA), 1.0 mm pitch 672-pin FC-FBGA
Type de montage Surface Mount Surface Mount
Programmable via JTAG Yes (IEEE 1149.1) —
Supported I/O Standards LVCMOS, LVTTL, SSTL, GTL+, HSTL —
Configuration Modes JTAG, passive serial, passive parallel —
Statut RoHS [DATA_NEEDED: RoHS status] [DATA_NEEDED: RoHS status]
Température de fonctionnement -40 °C to +85 °C (industrial) 0 °C to 85 °C
Niveau MSL [DATA_NEEDED: MSL rating] —
Device Logic Elements — 16,640 cells
Typical Gate Count — 400,000 system gates
Maximum User I/Os — 502
Propagation Delay — 2.5 ns
Internal Performance — 167 MHz
Core Supply Voltage — 2.5 V
Logic Family — CMOS, SRAM-based
Package Code — BGA
Number of Terminals — 672
Terminal Form — Ball (BGA)
Architecture — MultiCore (LUT + Embedded System Blocks)
Programming Method — SRAM, JTAG (ByteBlaster)
Statut du cycle de vie — Obsolete / Legacy

Fiches techniques et ressources

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