EPC1441TI32N vs EPC144TC32N Comparaison

Comparaison détaillée côte à côte de EPC1441TI32N par Intel et EPC144TC32N par Altera. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Comparaison des spécifications

Paramètre EPC1441TI32N EPC144TC32N
Marque Intel Altera
Catégorie Memory ICs FPGA & CPLD
Statut du cycle de vie Actif Obsolete
Statut du stock In Stock In Stock
Prix unitaire (USD) $5,45 $3,85
Type de mémoire OTP Configuration PROM (serial) —
Memory Density 440 kbit (440,800 bits) —
Number of Words 440,800 words —
Bits per Word 1 bit —
Memory Technology EPROM (one-time programmable) —
Tension d'alimentation 3.3 V —
Type d'interface Altera passive-serial (FPGA configuration) —
Programming Interface IEEE 1149.1 (JTAG) - 5 V and 3.3 V ISP IEEE Std 1149.1 JTAG (TMS, TCK, TDI, TDO)
Max Serial Clock 10 MHz (per datasheet.com) / 8 MHz (per Mouser listing) —
Package Type TQFP-32 (plastic, 7x7 mm) —
Type de montage Surface Mount Surface Mount
Operating Temperature Grade Industrial —
Nombre de broches 32 —
Statut RoHS Compliant —
Lead-Free Yes —
Supported FPGA Families ACEX 1K, APEX 20K, APEX II, Arria GX, Cyclone, Cyclone II, FLEX 10K, FLEX 6000, Mercury, Stratix, Stratix GX, Stratix II, Stratix II GX —
Device Type — Enhanced Configuration (EPC) Device, serial EEPROM
Configuration Memory Size — 440800 bits (approximately 54 KB)
Compatible FPGA Families — FLEX 8000, FLEX 10K, ACEX 1K, APEX 20K, Mercury
Configuration Interface — Altera serial (DATA0, DCLK, nCONFIG, nSTATUS, CONF_DONE)
In-System Programmability — Yes (ISP via JTAG)
Supply Voltage VCC — 3.0 V to 3.6 V (typical 3.3 V)
Supply Voltage VPP — Generated internally (no external VPP required)
Température de fonctionnement — -40C to +85C (industrial)
Boîtier — TQFP-32
Lead-Free / RoHS — [DATA_NEEDED: lead-free status]
Niveau MSL — [DATA_NEEDED: MSL level]
JTAG Chain Compatibility — Yes (shares TDI/TDO with target FPGA)
Programming Cycles — [DATA_NEEDED: endurance]

Fiches techniques et ressources

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