EPC2TC32U vs EPC2TC32-U-CAF48 Comparaison

Comparaison détaillée côte à côte de EPC2TC32U par Altera et EPC2TC32-U-CAF48 par Altera. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.

Comparaison des spécifications

Paramètre EPC2TC32U EPC2TC32-U-CAF48
Marque Altera Altera
Catégorie FPGA & CPLD FPGA & CPLD
Statut du cycle de vie NRND Actif
Statut du stock In Stock In Stock
Prix unitaire (USD) $5,85 $9,95
Fonction Serial Configuration Device for SRAM-based LUT FPGAs In-system programmable configuration PROM
Taille de mémoire 1.6 Mbit 1.6 Mb
Configuration Interface Altera Passive Serial (DCLK / DATA0 / nCONFIG / nSTATUS / CONF_DONE) —
JTAG Support Yes (IEEE 1149.1 boundary-scan, ISP) —
Tension d'alimentation 3.0 V to 3.6 V or 4.75 V to 5.25 V 3.3 V
Température de fonctionnement -40 C to +85 C -40C to +85C (industrial, per data sheet)
Boîtier 32-pin QFP (CAF48, lead-free) 32-TQFP (7x7 mm)
Type de montage Surface Mount Surface Mount
Niveau MSL [DATA_NEEDED: MSL level] —
Statut RoHS Compliant (lead-free / RoHS per distributor data) [DATA_NEEDED: RoHS status]
Lead-Free Finish Yes (U suffix) —
Supported FPGA Families Altera Stratix, Cyclone, APEX, ACEX, Mercury, Excalibur —
Configuration Mode Passive Serial (PS), JTAG —
Configuration Time [DATA_NEEDED: typical configuration time] —
Programming Cycles [DATA_NEEDED: minimum program/erase cycles] —
Data Retention [DATA_NEEDED: minimum data retention years] —
Interface — Serial synchronous (Altera FPGA configuration)
Programming Interface — IEEE 1149.1 JTAG
Control Pins — OE, nCS, DCLK
Cascadable — Yes (DATA output supports daisy-chain)
Storage Technology — EPROM
Nombre de broches — 32
DC Input Min — -0.3 V
DC Input Overshoot — 7.0 V for <100 mA, <20 ns
DC Input Undershoot — -2.0 V for <100 mA, <20 ns
Lead-Free — [DATA_NEEDED: lead-free status]

Fiches techniques et ressources

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