EPM3064ALC44-10 vs EPM3064ALC44-10N Comparaison
Comparaison détaillée côte à côte de EPM3064ALC44-10 par Altera et EPM3064ALC44-10N par Altera. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.
Altera
EPM3064ALC44-10N - MAX 3000A CPLD, 64 Macrocells, 34 I/O | Intel / Altera
EPM3064ALC44-10N ObsoleteComparaison des spécifications
| Paramètre | EPM3064ALC44-10 | EPM3064ALC44-10N |
|---|---|---|
| Marque | Altera | Altera |
| Catégorie | FPGA & CPLD | FPGA & CPLD |
| Statut du cycle de vie | NRND | Obsolete |
| Statut du stock | In Stock | In Stock |
| Prix unitaire (USD) | $4,12 | $4,25 |
| Family | MAX 3000A | — |
| Logic Elements / Macrocells | 64 macrocells | — |
| Number of Logic Array Blocks (LABs) | 4 | — |
| Usable Gates | 1,250 | 1,250 |
| Maximum User I/O Pins | 34 | — |
| Supply Voltage (VCCINT) | 3.3 V | 3.0 V to 3.6 V |
| Pin-to-Pin Delay (tPD) | 10 ns | — |
| Maximum Counter Frequency (fCNT) | 192.3 MHz | — |
| Maximum Operating Frequency (fMAX) | [DATA_NEEDED: fMAX internal] | — |
| Boîtier | 44-PLCC (J-Lead) | 44-pin PLCC (LC44) |
| Process Technology | 0.30 µm CMOS EEPROM | — |
| Programmability | In-system programmable (JTAG IEEE 1149.1) | — |
| MultiVolt I/O | 2.5V / 3.3V / 5.0V interface compatible | — |
| Température de fonctionnement | 0°C to +70°C (commercial) | [DATA_NEEDED: commercial / industrial grade] |
| Statut RoHS | Compliant (lead-free L suffix indicates Pb-free package) | Compliant |
| Type de montage | Surface Mount (PLCC socket compatible) | Surface Mount (PLCC socket compatible) |
| Product Family | — | MAX 3000A |
| Device Type | — | CPLD (Complex Programmable Logic Device) |
| Macrocells | — | 64 |
| Logic Array Blocks (LABs) | — | 4 |
| User I/O Pins | — | 34 |
| Propagation Delay (tPD) | — | 10 ns |
| Maximum Counter Frequency | — | 227.3 MHz |
| I/O Bank Voltage (VCCIO) | — | 3.0 V to 3.6 V (MultiVolt) |
| Configuration Memory | — | CMOS EEPROM |
| In-System Programmability | — | Yes (IEEE 1149.1 JTAG, IEEE 1532 compliant) |
| Open-Drain Output Option | — | Yes (per I/O pin) |
| Output Slew-Rate Control | — | Programmable |