EP1810JM-45 vs EP1810JI-45 তুলনা
. বিস্তৃত সাথে-সাথে তুলনা EP1810JM-45 নির্দিষ্ট Altera ও EP1810JI-45 নির্দিষ্ট Altera. প্রধান বিশেষত্ব, বৈদ্যুতিক প্রাকৃতিক, প্যাকেজিং, জীবনচক্র অবস্থা, মূল্যাঙ্কন, ও পরিসীমা কোন অপশনটির কেন্দ্রীয় নির্ধারণ করুন
বিশিষ্টতা তুলনা
| পারামিটার | EP1810JM-45 | EP1810JI-45 |
|---|---|---|
| ব্র্যান্ড | Altera | Altera |
| ক্যাটাগরি | FPGA & CPLD | FPGA & CPLD |
| লাইফসাইকেল স্ট্যাটাস | Obsolete | Obsolete |
| Device Family | Classic EPLD (EP1810 series) | — |
| Macrocells | 48 | — |
| Usable Gates | ~900 gates | — |
| Propagation Delay (tpd) | 45 ns (max, -45 speed grade) | — |
| Supply Voltage (VCC) | 4.5 V to 5.5 V | — |
| Technology | CMOS, UV-EPROM configuration | CMOS EPROM |
| Package Type | JLCC-68 (ceramic J-leaded chip carrier) | 68-pin JLCC (J-leaded ceramic chip carrier) |
| Package Code | JM (windowed ceramic, UV-erasable) | QCCJ |
| পিন সংখ্যা | 68 | — |
| অপারেটিং তাপমাত্রা | -55 C to +125 C (military grade) | -40 °C to +85 °C |
| I/O Compatibility | CMOS / TTL | — |
| Configuration Method | JEDEC fuse map, EPROM programmer | — |
| Programming Technology | UV-erasable EPROM (non-volatile, instant-on) | — |
| মাউন্টিং টাইপ | Surface Mount (J-lead) | — |
| Logic Type | EPLD / PLD (programmable logic device) | — |
| RoHS স্ট্যাটাস | [DATA_NEEDED: RoHS status - legacy mil-spec part] | — |
| MSL লেভেল | [DATA_NEEDED: MSL level] | — |
| Manufacturer | — | Altera (now Intel FPGA) |
| Series | — | Classic EPLD Family |
| Device Type | — | UV-Erasable / OTP Complex PLD |
| Macrocell Count | — | 48 |
| Maximum Operating Frequency | — | 33.3 MHz |
| Propagation Delay (tPD) | — | 50 ns |
| Configurable I/O Lines | — | 48 |
| Dedicated Inputs | — | 12 |
| Terminal Form | — | J BEND |
| Package Shape | — | SQUARE |
| Number of Terminals | — | 68 |
| Temperature Grade | — | INDUSTRIAL |
| সাপ্লাই ভোল্টেজ | — | 5 V (TTL compatible) |
| Programming Method | — | UV-erase (windowed) / OTP via JEDEC |