A3PE3000-FG896 vs A3PE3000L-FGG896M Comparación

Comparación detallada lado a lado de A3PE3000-FG896 por Microchip Technology y A3PE3000L-FGG896M por Microchip Technology. Compare las especificaciones clave, los parámetros eléctricos, el encapsulado, el estado del ciclo de vida, los precios y la disponibilidad para determinar el mejor componente para los requisitos de su diseño.

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A3PE3000-FG896 A3PE3000-FG896 - ProASIC3E Flash FPGA 620 I/O | Microchip

A3PE3000-FG896 - ProASIC3E Flash FPGA 620 I/O | Microchip

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A3PE3000L-FGG896M A3PE3000L-FGG896M - 3M-Gate Low-Power Flash FPGA | Microchip

A3PE3000L-FGG896M - 3M-Gate Low-Power Flash FPGA | Microchip

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Comparación de especificaciones

Parámetro A3PE3000-FG896 A3PE3000L-FGG896M
Marca Microchip Technology Microchip Technology
Categoría FPGA & CPLD FPGA & CPLD
Estado del ciclo de vida Activo Activo
Estado del stock In Stock In Stock
Precio unitario (USD) $129,80 $0,00
Family ProASIC3E ProASIC3L (Flash-based FPGA)
System Gates 3000000 3,000,000
Number of I/O 620 —
Embedded Memory 516096 bit —
Maximum System Frequency 231 MHz —
Process Technology 130 nm 130-nm, 7-layer metal (6 copper), flash-based CMOS
Core Supply Voltage 1.5 V —
Configuration Memory Flash (non-volatile, reprogrammable) —
Logic Element Count (per distributor listing) [DATA_NEEDED: verified LE/KLE count] —
Encapsulado 896-BGA (FBGA) 896-ball FBGA (FGG896), 1 mm pitch
Estilo de montaje SMD/SMT —
Temperatura de funcionamiento 0 C to +70 C 0 to 70 C
Packaging Tray —
Speed Grade Standard (-) —
Architecture VersaTile 3-input LUT / D flip-flop / latch —
Global Networks VersaNet low-skew high-fanout networks —
Estado RoHS Non-green package (FG prefix; FGG variants are RoHS green) —
Logic Cells — 75,264
User I/Os — Up to 616 (620 per DigiKey listing)
Embedded SRAM — 504 kbits true dual-port
Core Voltage — 1.2 V to 1.5 V
Tensión de alimentación — 1.5 V
Logic Family — CMOS
Tipo de montaje — Surface Mount
Configuration — Non-volatile flash, live-at-power-up Level 0, single-chip
Low-Power Feature — Flash*Freeze technology
Boundary Scan — IEEE 1149.1 (JTAG)
Input Features — Schmitt trigger option on single-ended inputs; weak pull-up/pull-down

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