MCIMX31CVMN4CR2 vs MCIMX31LCVMN4C Comparación

Comparación detallada lado a lado de MCIMX31CVMN4CR2 por NXP Semiconductors y MCIMX31LCVMN4C por NXP Semiconductors. Compare las especificaciones clave, los parámetros eléctricos, el encapsulado, el estado del ciclo de vida, los precios y la disponibilidad para determinar el mejor componente para los requisitos de su diseño.

NXP Semiconductors
MCIMX31CVMN4CR2 MCIMX31CVMN4CR2 - i.MX31 ARM1136 400MHz MPU, 473-LFBGA | NXP

MCIMX31CVMN4CR2 - i.MX31 ARM1136 400MHz MPU, 473-LFBGA | NXP

MCIMX31CVMN4CR2 Nrnd
NXP Semiconductors
MCIMX31LCVMN4C MCIMX31LCVMN4C - i.MX31L ARM1136 400MHz MPU, MAPBGA-457 | NXP

MCIMX31LCVMN4C - i.MX31L ARM1136 400MHz MPU, MAPBGA-457 | NXP

MCIMX31LCVMN4C ⚠ Última compra

Comparación de especificaciones

Parámetro MCIMX31CVMN4CR2 MCIMX31LCVMN4C
Marca NXP Semiconductors NXP Semiconductors
Categoría Microcontrollers Microcontrollers
Estado del ciclo de vida NRND Última compra
Estado del stock In Stock In Stock
Precio unitario (USD) $17,10 $10,50
Core Architecture ARM1136JF-S ARM1136JF-S
Core Count 1 1
Ancho del bus de datos 32-bit 16-bit
Maximum Core Frequency 400 MHz —
Tensión de alimentación de funcionamiento 1.8 V to 2.0 V core, 1.8 V to 3.3 V I/O —
Encapsulado / Carcasa 473-LFBGA (MAPBGA-473) —
Package Dimensions 19 mm x 19 mm 14 x 14 mm
Tipo de montaje Surface Mount Surface Mount
RAM Size (on-chip SRAM) 16K x 8 —
Packaging Tape & Reel (TR) —
Oscillator Type External —
On-chip Multimedia MPEG-4/H.263 encoder/decoder, Image Processing Unit (IPU) —
Peripheral Interfaces USB, Ethernet MAC, UART, I2C, SPI, MMC/SD —
Rango de temperatura de funcionamiento -40 C to +85 C (automotive/industrial grade) -40C to +85C
Family i.MX31 multimedia applications processors i.MX31L
Estado RoHS Compliant Compliant
Lead-Free / Halogen-Free [DATA_NEEDED: lead-free and halogen-free status] —
Frecuencia de reloj máxima — 400 MHz
Package Type — MAPBGA-457
Ball Pitch — 0.5 mm
Recuento de pines — 457
Variant Suffix — N4C (industrial/auto temp grade)
Process Node — [DATA_NEEDED: process node]
L1 Cache — [DATA_NEEDED: L1 instruction/data cache]
L2 Cache — [DATA_NEEDED: L2 cache]
Integrated LCD Controller — Yes
USB Interface — USB 2.0 with on-chip PHY
Image Processing Unit (IPU) — Yes
AEC-Q100 Grade — Grade 3

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